Table of Contents
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Tables
80
DMA LCD Bottom Address B1 L Register (BOT_B1_L)
81
DMA LCD Bottom Address B1 U Register (BOT_B1_U)
82
DMA LCD Top Address B2 L Register (TOP_B2_L)
83
DMA LCD Top Address B2 U Register (TOP_B2_U)
84
DMA LCD Bottom Address B2 L Register (BOT_B2_L)
85
DMA LCD Bottom Address B2 U Register (BOT_B2_U)
86
DMA LCD Source Element Index B1 Register (DMA_LCD_SRC_EI_B1)
87
DMA LCD Source Frame Index B1 Register L (DMA_LCD_SRC_FI_B1_L)
88
DMA LCD Source Frame Index B1 Register U (DMA_LCD_SRC_FI_B1_U)
89
DMA LCD Source Element Index B2 Register (DMA_LCD_SRC_EI_B2)
90
DMA LCD Source Frame Index B2 Register L (DMA_LCD_SRC_FI_B2_L)
91
DMA LCD Source Frame Index B2 Register U (DMA_LCD_SRC_FI_B2_U)
92
DMA LCD Source Element Number B1 Register (DMA_LCD_SRC_EN_B1)
93
DMA LCD Source Frame Number B1 Register (DMA_LCD_SRC_FN_B1)
94
DMA LCD Source Element Number B2 Register (DMA_LCD_SRC_EN_B2)
95
DMA LCD Source Frame Number B2 Register (DMA_LCD_SRC_FN_B2)
96
DMA LCD Logical Channel Control Register (DMA_LCD_LCH_CTRL)
97
Possible DMA Transfers
98
Autoinitialization Bits
99
Activity Shown in 20
100
Registers Used to Define the Start Addresses for a DMA Transfer
101
DMA Controller Ports
102
DMA Data Packing
103
Data Block to Transfer
104
Address and Access Types
105
Read/Write Synchronization
106
DMA Controller Operational Events and Associated Bits/Interrupts
107
DMA Controller Configuration Registers
108
Global Control Register (DMA_GCR)
109
Global Time-Out Control Register (DMA_GTCR)
110
Global Software Incompatible Control Register (DMA_GSCR)
111
Channel Source Destination Parameters Registers (DMA_CSDP0...DMA_CSDP5)
112
Channel Control Registers (DMA_CCR0...DMA_CCR5)
113
DSP DMA Mapping
114
Channel Interrupt Control Registers (DMA_CICR0...DMA_CICR5)
115
Channel Status Registers (DMA_CSR0...DMA_CSR5)
116
Channel Source Start Address, Lower Bits Registers
(DMA_CSSA_L0...DMA_CSSA_L5)
117
Channel Source Start Address, Upper Bits Registers
(DMA_CSSA_U0...DMA_CSSA_U5)
118
Channel Destination Start Address, Lower Bits Register
(DMA_CDSA_L0...DMA_CDSA_L5)
119
Channel Destination Start Address, Upper Bits Registers
(DMA_CDSA_U0...DMA_CDSA_U5)
120
Channel Element Number Registers (DMA_CEN0...DMA_CEN5)
10
OMAP5912
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SPRU755B
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