Table of Contents
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1
Watchdog Timer Clock Domains
2
Write Posted Status Register (WWPS)
3
Prescaler Clock Ratios
4
Reset Period Examples
5
Watchdog Timer Registers
6
Watchdog HW Revision (ID) Register (WIDR)
7
Watchdog System Configuration Register (WD_SYSCONFIG)
8
Watchdog System Status Register (WD_SYSSTATUS)
9
Watchdog Control Register (WCLR)
10
Watchdog Counter Register (WCRR)
11
Watchdog Load Register (WLDR)
12
Watchdog Trigger Register (WTGR)
13
Watchdog Write Pending Register (WWPS)
14
Watchdog Start/Stop Register (WSPR)
15
Time-Out for 32-kHz Watchdog Timer
16
Valid Prescaler Values for OS Timer Configuration
17
Example MPU OS Timer Interrupt Periods
18
DSP OS Timer Registers
19
DSP Control Timer Register (DSP_CNTL_TIMER)
20
DSP Load Timer Value, 1/2 LSW (DSP_LOAD_TIMER_LO)
21
DSP Load Timer Value, 1/2 MSW (DSP_LOAD_TIMER_HI)
22
DSP Read Timer Value, 1/2 LSW (DSP_READ_TIMER_LO)
23
DSP Read Timer Value, 1/2 MSW (DSP_READ_TIMER_HI)
24
MPU OS Timer Registers
25
MPU Control Timer Register (MPU_CNTL_TIMER)
26
MPU Load Timer Register Value (MPU_LOAD_TIMER)
27
MPU Read Timer Register Value (MPU_READ_TIMER)
28
Access Types (Posted Mode vs Nonposted Mode) for Various Clock Selections
29
Prescaler/Timer Reload Values Versus Contexts
30
Prescaler Clock Ratios Values
31
Value and Corresponding Interrupt Period
32
Dual-Mode Timer Registers
33
Timer Identification Register (TIDR)
34
Timer OCP Configuration Register (TIOCP_CFG)
35
Timer System Status Register (TISTAT)
36
Timer Status Register (TISR)
SPRU759B
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OMAP5912
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Chapters
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