Table of Contents
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Tables
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1
Presence-Check Truth Table
2
ST3 CPU Register (ST3)
3
Global Control Register (GCR)
4
Flush Line Register 0 (FLR0)
5
Flush Line Register 1 (FLR1)
6
I-Cache N-Way Register (NWCR)
7
I-Cache Status Register (ISR)
½
8
Ramset Control Registers (RCR1, RCR2)
½
9
Ramset TAG Registers (RTR1, RTR2)
10
I-Cache LVB and LRU I/O Space Map
11
I/O Spaces
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12
DSP Peripheral Mapping
13
Control Mode Register (CMR)—Value at Reset is 0xFE4D
14
Wait States
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15
Idle Configuration Register (ICR)
16
Idle Status Register (ISTR)
17
EMIF Global Control Register (EMIF GCR)
18
Page Protection Field
19
DSP MMU Registers
20
Prefetch Register (PREFETCH_REG)
21
Status Register (WALKING_ST_REG)
22
Control Register (CNTL_REG)
23
MSB Fault Address Register (FAULT_AD_H_REG)
24
LSB Fault Address Register (FAULT_AD_L_REG)
25
Fault Status Register (FAULT_ST_REG)
26
It Acknowledge Register (IT_ACK_REG)
27
MSB TTB Register (TTB_H_REG)
28
LSB TTB Register (TTB_L_REG)
29
Lock Counter Register (LOCK_REG)
30
Load Entry in TLB Register (LD_TLB_REG)
31
MSB of CAM Entry Register (CAM_H_REG)
32
LSB of CAM Entry Register (CAM_L_REG)
33
MSB of RAM Entry Register (RAM_H_REG)
34
LSB of RAM Entry Register (RAM_L_REG)
35
Global Flush Register (GFLUSH_REG)
36
Flush One Register (FLUSH_ENTRY_REG)
12
OMAP5912
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32
32
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SPRU750A
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