Table of Contents
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1
DSP Subsystem and Modules
2
DSP Core and Internal Bus Designations
3
C55x DSP Architecture
4
DSP Memory Connections
5
Virtual Address Mapped to Cache Line
6
Cache Structure—Direct-Mapped Cache Block
7
Two-Way Set-Associative Cache Structure
½
8
Ramset Cache Structure
9
DSP Memory Space
10
DSP Subsystem Modules
11
DSP MMU Architecture
12
Address Translation Process for a Section
13
Translation Table Hierarchy
14
Level One Descriptor
15
Level Two Descriptor
16
Translation for a Section
17
Translation for a Large Page Included in a Coarse Page
18
Translation for a Small Page Included in a Coarse Page
19
Translation for a Large Page Included in a Fine Page
20
Translation for a Small Page Included in a Fine Page
21
Translation for a Tiny Page Included in a Fine Page
22
DSP Memory Request Results Example
SPRU750A
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OMAP5912
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