Texas Instruments OMAP5912 Reference Manual page 961

Contents
3.5 1x OCP Master Port
3.6 Address Space
3.7 Arbiter Block
3.8 Buffer Block
4 SSI Interconnect
4.1 Introduction
4.2 OCP to VIA Asynchronous Bridge
4.3 OCP to VIA Synchronous Bridge
4.4 Decode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5 DMA and Interrupt Formatter
4.6 Clock and Reset Module
4.7 Programming Model
4.7.1 OCPI REGISTERS (MPU Address: FFFE:C320)
4.7.2 OCPT REGISTERS (MPU Address: FFFE:CC00)
4.7.3 Power Saving Modes
5 On-Chip/Off-Chip Memory and Peripheral Access Latencies
10 OMAP5912
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