Texas Instruments OMAP5912 Reference Manual page 818

Tables
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1 Command Operations
2 Pointer Operation
3 Sent Address Function of Core Sizes
4 Programming Address for Erase Operation
5 Formatting of Erase Address in Address Register
6 Formatting of Erase Address in Address Register With Bit A8 Not Sent
7 Status Register Mapping for 32, 64, 128, and 256 Megabits
8 Status Register Mapping for 512, 1024 Megabits
9 Bit Mapping of ECC Registers
10 Decision Table When Operation Fails
11 Prefetch/Postwrite Mode
12 Characteristics of Supported NFMCs
13 Supported Operations on NFMCs
14 Register Mapping
15 NAND Flash Registers
16 NAND Controller Revision Register (NND_REVISION)
17 NAND Controller Access Register (NND_ACCESS)
18 NAND Controller Address Register (NND_ADDR_SRC)
19 Address Decomposition
20 NAND Controller Control Register (NND_CTRL)
21 ECC Bits Operation
22 Byte Packing Function of MBYTEEN and Little/Big Endianism
(NND_ACCESS/NND_FIFO)
23 Byte Packing Function of MBYTEEN for Registers
(Except NND_ACCESS/NND_FIFO).
24 1 Gigabit Dual-Die Layout of Bytes Sent
25 1 Gigabit Mono-Die Layout of Bytes Sent
26 NND_ADDR_SRC Decompostion of Flash Bus Function of Control Bit A8
27 Address Counter for Sending Bytes
28 NAND Controller Mask Register (NND_MASK)
29 NAND Controller Status Register (NND_STATUS)
30 How to Clear Pending Event
31 NAND Controller Ready Register (NND_READY)
32 NAND Controller Command Register (NND_COMMAND)
33 NAND Controller Second Command Register (NND_COMMAND_SEC)
34 NAND Controller EEC Bank Selection Register (NND_ECC_SELECT)
35 Legal Values for NND_ECC_SELECT Registers
12 OMAP5912
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