Table of Contents
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75
DSP Idle Enable Control Register 1 (DSP_IDLECT1)
76
DSP Idle Enable Control Register 2 (DSP_IDLECT2)
77
DSP Reserved Register 1 (DSP_EWUPCT)
78
DSP Reserved Register 2 (DSP_RSTCT1)
79
DSP Peripherals Reset Register (DSP_RSTCT2)
80
DSP Clock Reset Status Register (DSP_SYSST)
81
DSP Reserved Register 3 (DSP_CKOUT1)
82
DSP Reserved Register 4 (DSP_CKOUT2)
83
DPLL Registers
84
DPLL1 Control Register (DPLL1_CTL_REG)
85
DPLL2 Control Register (DPLL2_CTL_REG)
86
Data Swap for 32-Bit Access for MPUI Port
87
Data Swap for 16-Bit Access for MPUI Port
88
MPUI Port Registers
89
MPUI Port Interrupt Register (APIRI)
90
MPUI Port Control/Status Register (APIRS)
91
MPUI Registers
92
MPUI Control Register (MPUI_CONTROL)
93
Debug Address Register (DEBUG_ADDRESS)
94
Debug Data Register (DEBUG_DATA)
95
Debug Flag Register (DEBUG_FLAG)
96
MPUI Status Register (MPUI_STATUS)
97
DSP Status Register (DSP_STATUS)
98
DSP Boot Configuration Register (DSP_BOOT_CONFIG)
99
MPUI Port RAM Configuration Register (DSP_MPUI_CONFIG)
100
DSP Miscellaneous (DSP_MISC)
101
MPUI Enhanced Control Register (MPUI_ENHANCED_CTRL)
102
DSP SARAM Configuration Map
103
DSP Endianism Register (DSP_ENDIAN_CONV)
104
Mailbox Registers
105
MPU to DSP Mailbox 1A Register (MPU2DSP1A)
106
MPU to DSP Mailbox 1B Register (MPU2DSP1B)
107
DSP to MPU Mailbox 1A Register (DSP2MPU1A)
108
DSP to MPU Mailbox 1B Register (DSP2MPU1B)
109
DSP to MPU Mailbox 2A Register (DSP2MPU2A)
110
DSP to MPU Mailbox 2B Register (DSP2MPU2B)
111
MPU to DSP Mailbox 1 Flag Register (MPU2DSP1_FLAG)
112
DSP to MPU Mailbox 1 Flag Register (DSP2MPU1_FLAG)
113
DSP to MPU Mailbox 2 Flag Register (DSP2MPU2_FLAG)
114
MPU to DSP Mailbox 2A Register (MPU2DSP2A)
115
MPU to DSP Mailbox 2B Register (MPU2DSP2B)
116
MPU to DSP Mailbox 2 Flag Register (MPU2DSP2_FLAG)
117
TIPB Registers
118
TIPB Control Register (RHEA_CNTL)
SPRU749A
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Tables
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OMAP5912
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197
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Chapters
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