Table of Contents
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System DMA Idle Control
MPU TIPB Bridges Idle Control
4.3.4
External Device Power Control
4.3.5
DPLL Idle Control
4.3.6
Chip Idle Mode, Deep Sleep Mode, and Wake-up Control
4.4
Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.4.1
MPU Registers
4.4.2
DSP Registers
4.4.3
DPLL Registers
5
MPU and MPUI Port
5.1
MPUI
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
5.1.1
Access Request
5.1.2
Endian Conversion
5.1.3
MPUI Strobe and Access Factor
5.1.4
MPUI Port RAM Access
5.1.5
Peripheral Access
5.1.6
MPUI and DSP TIPB Bridge Time-Out
5.1.7
Debug
5.2
MPUI Port
5.2.1
Access Modes
5.2.2
Memory Accesses in HOM
5.2.3
Memory Accesses in SAM
5.2.4
Peripheral Accesses in HOM
5.2.5
Peripheral Accesses in SAM
5.2.6
Posted Write Mode
5.2.7
Bus Error
5.2.8
Interrupt
5.3
MPUI Port and MPUI Registers
5.3.1
MPUI Registers
5.4
DSP Endianism Register
6
Mailboxes
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
6.1
Mailbox Registers
6.1.1
Mailbox Interrupts
6.1.2
Mailbox Software
6.2
Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
7
TIPB Bridge
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7.1
Functionality
7.1.1
Bus Allocation
7.1.2
Access Permissions
7.1.3
TIPB Strobes and Access Factor
7.1.4
MPU Posted Write
7.1.5
Time-Out
7.1.6
Debug
7.2
Registers
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
SPRU749A
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195
195
195
196
196
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OMAP5912
11
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Chapters
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