Table Of Contents - Texas Instruments OMAP5910 Technical Reference Manual

1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
Introduces the setup, components, and features of the OMAP5910 processor and provides a
high-level view of the device architecture.
1.1 Overview
1.2 Description
1.3 Features
1.4 Architecture
1.5 Memory Maps
1.6 Software Compatibility
1.6.1 OMAP Driver Compatibility Conventions
2 MPU Subsystem
Describes the core, caches, memory management units (MMUs), interface, and bridges of the
OMAP5910 multimedia processor microprocessor unit (MPU) subsystem.
2.1 Introduction
2.2 MPU Core
2.3 Instruction Cache
2.3.1 Operation
2.3.2 Validity
2.4 Data Cache
2.4.1 D-Cache Operation
2.4.2 Validity
2.4.3 Double-Mapped Space
2.5 Write Buffer
2.5.1 Operation
2.5.2 SWAP Instruction
2.6 Coprocessor 15
2.6.1 CP15 Access
2.6.2 Register Descriptions
2.7 MPU Memory Management Unit
2.7.1 Translation Look-Aside Buffer
2.7.2 Translation Table
2.7.3 Domains and Access Permissions
2.7.4 MMU Program-Accessible Registers
2.7.5 Address Translation
2.7.6 Translation Process
2.7.7 MMU Faults and MPU Aborts
2.7.8 Fault Address and Fault Status Registers (FAR and FSR)
2.7.9 Domain Access Control
2.7.10 Permission Access
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Contents
Contents
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