Outputs Olo; Init[14] Init; Init[15] Init - Xilinx Virtex-6 Manual

Chapter 4: About Design Elements
Inputs
I4 I3
0 0
0 0
0 1
0 1
0 1
0 1
0 1
0 1
0 1
0 1
1 0
1 0
1 0
1 0
1 0
1 0
1 0
1 0
1 1
1 1
1 1
1 1
1 1
1 1
1 1
1 1
INIT = Binary equivalent of the hexadecimal number assigned to the INIT attribute
Port Description
Name Direction
O Output
L0 Output
I0, I1, I2, I3, I4 Input
226
I2 I1
1 1
1 1
0 0
0 0
0 1
0 1
1 0
1 0
1 1
1 1
0 0
0 0
0 1
0 1
1 0
1 0
1 1
1 1
0 0
0 0
0 1
0 1
1 0
1 0
1 1
1 1
Width Function
1 5-LUT output
1
5-LUT output for internal CLB connection
1 LUT inputs
www.xilinx.com
Outputs
I0 O
0 INIT[6]
1 INIT[7]
0 INIT[8]
1 INIT[9]
0 INIT[10]
1 INIT[11]
0 INIT[12]
1 INIT[13]
0 INIT[14]
1 INIT[15]
0 INIT[16]
1 INIT[17]
0 INIT[18]
1 INIT[19]
0 INIT[20]
1 INIT[21]
0 INIT[22]
1 INIT[23]
0 INIT[24]
1 INIT[25]
0 INIT[26]
1 INIT[27]
0 INIT[28]
1 INIT[29]
0 INIT[30]
1 INIT[31]
Virtex-6 Libraries Guide for HDL Designs
UG623 (v 14.5) March 20, 2013
LO
INIT[6]
INIT[7]
INIT[8]
INIT[9]
INIT[10]
INIT[11]
INIT[12]
INIT[13]
INIT[14]
INIT[15]
INIT[16]
INIT[17]
INIT[18]
INIT[19]
INIT[20]
INIT[21]
INIT[22]
INIT[23]
INIT[24]
INIT[25]
INIT[26]
INIT[27]
INIT[28]
INIT[29]
INIT[30]
INIT[31]