Motorola DragonBall MC9328MX1 Reference Manual page 46

Table 25-6 Pin Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-19
Table 25-7 SSI Module Register Memory Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-19
Table 25-8 Register Field Summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-20
Table 25-9 Port Control Register Descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-22
Table 25-10 Control Register Descriptions. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-23
Table 25-11 Receive Threshold Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-26
Table 25-12 Transmit/Receive Enable Register Description . . . . . . . . . . . . . . . . . . . . . . . 25-26
Table 25-13 Transmit Status Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-27
Table 25-14 Receive Status Register Description. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-29
Table 25-15 Interrupt Mask Register Description. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-31
Table 25-16 Port Transmit Buffer Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-32
Table 25-17 Receive Buffer Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-33
Table 25-18 Port Detect Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-34
Table 25-19 Transmit Threshold Register Description. . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-35
Table 25-20 Transmit Guard Control Register Description . . . . . . . . . . . . . . . . . . . . . . . . 25-36
Table 25-21 Open-Drain Configuration Control Register Description. . . . . . . . . . . . . . . . 25-37
Table 25-22 Reset Control Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-38
Table 25-23 Character Wait Timer Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . 25-39
Table 25-24 General Purpose Counter Register Description . . . . . . . . . . . . . . . . . . . . . . . 25-40
Table 25-25 Divisor Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-41
Table 25-26 Configuring the SIM for Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-41
Table 25-27 Configuring the SIM Receiver . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-42
Table 25-28 Configuring the SIM Transmitter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25-43
Table 25-29 Configuring the SIM General Purpose Counter . . . . . . . . . . . . . . . . . . . . . . . 25-44
Table 25-30 Configuring the SIM Linear Redundancy Check Block. . . . . . . . . . . . . . . . . 25-44
Table 25-31 Configuring the SIM Cyclic Redundancy Check Block. . . . . . . . . . . . . . . . . 25-45
Table 26-1 Pin Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26-2
Table 26-2 GP Timers Module Register Memory Map . . . . . . . . . . . . . . . . . . . . . . . . . . . 26-3
Table 26-3 Timer 1 and 2 Control Registers Description . . . . . . . . . . . . . . . . . . . . . . . . . . 26-4
Table 26-4 Timer 1 and 2 Prescaler Registers Description. . . . . . . . . . . . . . . . . . . . . . . . . 26-5
Table 26-5 Timer 1 and 2 Compare Registers Description. . . . . . . . . . . . . . . . . . . . . . . . . 26-6
Table 26-6 Timer 1 and 2 Capture Registers Description. . . . . . . . . . . . . . . . . . . . . . . . . . 26-7
Table 26-7 Timer 1 and 2 Counter Registers Description . . . . . . . . . . . . . . . . . . . . . . . . . 26-8
Table 26-8 Timer 1 and 2 Status Registers Description . . . . . . . . . . . . . . . . . . . . . . . . . . . 26-9
Table 27-1 UART Module Interface Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27-2
Table 27-2 Pin Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27-3
Table 27-3 Interrupts and DMA . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27-4
Table 27-4 RTS Edge Triggered Interrupt Truth Table . . . . . . . . . . . . . . . . . . . . . . . . . . . 27-6
Table 27-5 DTR Edge Triggered Interrupt Truth Table . . . . . . . . . . . . . . . . . . . . . . . . . . . 27-7
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