Motorola DragonBall MC9328MX1 Reference Manual page 43

Table 20-15 Interrupt Mechanisms . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-27
Table 20-16 MMC/SD Command Number Register Description. . . . . . . . . . . . . . . . . . . . 20-29
Table 20-17 MMC/SD Higher Argument Register Description . . . . . . . . . . . . . . . . . . . . . 20-30
Table 20-18 MMC/SD Lower Argument Register Description . . . . . . . . . . . . . . . . . . . . . 20-30
Table 20-19 MMC/SD Response FIFO Register Description . . . . . . . . . . . . . . . . . . . . . . 20-31
Table 20-20 MMC/SD Buffer Access Register Description. . . . . . . . . . . . . . . . . . . . . . . . 20-32
Table 20-21 Structure of Command Data Block. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-46
Table 20-22 Card Status Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-49
Table 20-23 SD Status Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-52
Table 20-24 Command Format . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-56
Table 20-25 Commands for MMC/SD Module . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-56
Table 20-26 R1 Response . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-61
Table 20-27 R2 Response . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-61
Table 20-28 R3 Response . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-61
Table 20-29 R4 Response . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-62
Table 20-30 R4b Response . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-62
Table 20-31 R5 Response . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-62
Table 20-32 R6 Response . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-63
Table 21-1 Pin Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-4
Table 21-2 MSHC Module Interrupt Sources Summary . . . . . . . . . . . . . . . . . . . . . . . . . . 21-5
Table 21-3 Interrupt Detect Capability on Power Save Mode . . . . . . . . . . . . . . . . . . . . . . 21-8
Table 21-4 Serial Clock Divider Settings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-11
Table 21-5 MSHC Module DMA Configuration Options . . . . . . . . . . . . . . . . . . . . . . . . 21-12
Table 21-6 MSHC Module Register Memory Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-12
Table 21-7 Memory Stick Command Register Description . . . . . . . . . . . . . . . . . . . . . . . 21-13
Table 21-8 Memory Stick Control/Status Register Description . . . . . . . . . . . . . . . . . . . . 21-14
Table 21-9 Memory Stick Transmit FIFO Data Register Description . . . . . . . . . . . . . . . 21-16
Table 21-10 Memory Stick Receive FIFO Data Register Description . . . . . . . . . . . . . . . . 21-17
Table 21-11 Memory Stick Interrupt Control/Status Register Description . . . . . . . . . . . . 21-17
Table 21-12 Memory Stick Parallel Port Control/Data Register Description. . . . . . . . . . . 21-19
Table 21-13 Memory Stick Control 2 Register Description . . . . . . . . . . . . . . . . . . . . . . . . 21-20
Table 21-14 Memory Stick Auto Command Register Description. . . . . . . . . . . . . . . . . . . 21-21
Table 21-15 Memory Stick FIFO Access Error Control/Status Register Description . . . . 21-22
Table 21-16 Memory Stick Serial Clock Divider Register Description . . . . . . . . . . . . . . . 21-23
Table 21-17 Memory Stick DMA Request Control Register Description . . . . . . . . . . . . . 21-24
Table 21-18 Serial Interface Signal Specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-25
Table 21-19 Four State Access Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-25
Table 21-20 Write Packet . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-26
Table 21-21 Read Packet. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-27
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