Table of Contents
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Power control (PWR)
Table 45. Functionalities depending on system operating mode
Peripheral
CPU1
CPU2
Radio-system (sub-GHz)
Flash memory
(up to 256 Kbytes)
Flash memory interface
SRAM1
SRAM2
Backup registers
Brownout reset (BOR)
Programmable voltage
detector (PVD)
Peripheral voltage monitor
(PVM3)
DMAx (x = 1, 2)
DMAMUX1
High-speed internal (HSI16)
High-speed external (HSE32)
Low-speed internal (LSI)
Low-speed external (LSE)
Multi-speed internal (MSI)
Clock security system (CSS)
Clock security system on LSE
RTC/auto wake-up
Number of TAMP tamper pins
USARTx (x= 1, 2)
Low-power UART (LPUART1)
I2Cx (x = 1, 2)
I2C3
SPI1
246/1450
Stop 0
-
Y
-
Y
-
R
Y
-
Y
-
R
O
O
O
O
O
(2)
O
(2)
(3)
Y
O
O
R
(3)
Y
Y
Y
Y
R
(2)
(2)
Y
O
Y
O
R
(2)
(2)
Y
O
Y
O
R
Y
Y
Y
Y
R
Y
Y
Y
Y
Y
O
O
O
O
O
O
O
O
O
O
O
O
O
O
R
O
O
O
O
R
(6)
O
O
O
O
O
(7)
(7)
(7)
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
O
R
O
O
O
O
O
O
O
O
O
O
3
3
3
3
3
(8)
O
O
O
O
O
(8)
O
O
O
O
O
(9)
O
O
O
O
O
(9)
O
O
O
O
O
O
O
O
O
R
RM0453 Rev 5
Stop 1
Stop 2
-
-
-
R
-
R
-
R
-
R
O
O
O
O
-
R
-
R
-
R
-
R
-
R
-
R
-
R
-
R
-
R
-
R
Y
Y
Y
Y
O
O
O
O
O
O
O
O
-
R
-
-
-
R
-
-
(6)
(6)
-
O
-
O
(7)
(7)
-
O
-
O
-
O
-
O
-
O
-
O
-
O
-
O
-
R
-
-
O
O
O
O
O
O
O
O
O
3
O
3
(8)
(8)
(8)
O
O
O
-
(8)
(8)
(8)
(8)
O
O
O
O
O
(9)
(9)
(9)
O
O
O
-
(9)
(9)
(9)
(9)
O
O
O
O
O
-
R
-
-
RM0453
(1)
Standby
Shutdo
-
-
-
-
-
-
-
-
-
-
-
-
O
O
O
-
-
-
R
-
R
-
-
-
-
-
-
-
-
-
-
-
(4)
-
O
-
-
-
-
R
-
R
-
Y
Y
Y
-
-
(5)
(5)
O
O
O
-
-
O
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
-
(7)
-
O
-
-
-
-
O
-
-
-
-
O
-
O
-
-
-
-
-
-
-
-
-
-
-
O
O
O
-
-
O
O
O
O
O
O
3
O
3
O
-
-
-
-
-
(8)
-
-
-
-
-
-
-
-
-
(9)
-
-
-
-
-
-
-
-
-
-
-
-
R
-
-
-
R
-
-
-
-
-
-
-
-
O
-
-
-
O
3
-
-
-
-
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