Silicon Laboratories EFR32xG14 Wireless Gecko Reference Manual page 13

16.5.16 PCNTn_OVSCFG - Oversampling Config Register (Async Reg)
17. I2C - Inter-Integrated Circuit Interface . . . . . . . . . . . . . . . . . . . . . 478
17.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 478
17.2 Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 478
17.3 Functional Description
17.3.1 I2C-Bus Overview . . . . . . . . . . . . . . . . . . . . . . . . . 480
17.3.2 Enable and Reset . . . . . . . . . . . . . . . . . . . . . . . . . 484
17.3.3 Safely Disabling and Changing Slave Configuration. . . . . . . . . . . . . . 484
17.3.4 Clock Generation . . . . . . . . . . . . . . . . . . . . . . . . . 484
17.3.5 Arbitration. . . . . . . . . . . . . . . . . . . . . . . . . . . . 485
17.3.6 Buffers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 485
17.3.7 Master Operation . . . . . . . . . . . . . . . . . . . . . . . . . 487
17.3.8 Bus States
17.3.9 Slave Operation
17.3.10 Transfer Automation . . . . . . . . . . . . . . . . . . . . . . . . 499
17.3.11 Using 10-bit Addresses . . . . . . . . . . . . . . . . . . . . . . . 500
17.3.12 Error Handling . . . . . . . . . . . . . . . . . . . . . . . . . . 500
17.3.13 DMA Support . . . . . . . . . . . . . . . . . . . . . . . . . . 502
17.3.14 Interrupts
17.3.15 Wake-up . . . . . . . . . . . . . . . . . . . . . . . . . . . . 502
17.4 Register Map. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 503
17.5 Register Description . . . . . . . . . . . . . . . . . . . . . . . . . . 504
17.5.1 I2Cn_CTRL - Control Register
17.5.2 I2Cn_CMD - Command Register
17.5.3 I2Cn_STATE - State Register . . . . . . . . . . . . . . . . . . . . . 508
17.5.4 I2Cn_STATUS - Status Register . . . . . . . . . . . . . . . . . . . . 509
17.5.5 I2Cn_CLKDIV - Clock Division Register
17.5.6 I2Cn_SADDR - Slave Address Register . . . . . . . . . . . . . . . . . 510
17.5.7 I2Cn_SADDRMASK - Slave Address Mask Register . . . . . . . . . . . . . 511
17.5.8 I2Cn_RXDATA - Receive Buffer Data Register (Actionable Reads) . . . . . . . . 511
17.5.9 I2Cn_RXDOUBLE - Receive Buffer Double Data Register (Actionable Reads)
17.5.10 I2Cn_RXDATAP - Receive Buffer Data Peek Register . . . . . . . . . . . . 512
17.5.11 I2Cn_RXDOUBLEP - Receive Buffer Double Data Peek Register . . . . . . . . 513
17.5.12 I2Cn_TXDATA - Transmit Buffer Data Register
17.5.13 I2Cn_TXDOUBLE - Transmit Buffer Double Data Register
17.5.14 I2Cn_IF - Interrupt Flag Register . . . . . . . . . . . . . . . . . . . 515
17.5.15 I2Cn_IFS - Interrupt Flag Set Register
17.5.16 I2Cn_IFC - Interrupt Flag Clear Register
17.5.17 I2Cn_IEN - Interrupt Enable Register . . . . . . . . . . . . . . . . . . 521
17.5.18 I2Cn_ROUTEPEN - I/O Routing Pin Enable Register
17.5.19 I2Cn_ROUTELOC0 - I/O Routing Location Register . . . . . . . . . . . . . 523
18. USART - Universal Synchronous Asynchronous Receiver/Transmitter . . . . . . . . 526
18.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 526
18.2 Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 527
18.3 Functional Description
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