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8.12 Set the Transmit Data Delay
8.12.1 Data Delay
8.12.2 0-Bit Data Delay
8.12.3 2-Bit Data Delay
8.13 Set the Transmit DXENA Mode
8.13.1 DXENA Mode
8.14 Set the Transmit Interrupt Mode
8.15 Set the Transmit Frame-Synchronization Mode
8.15.1 Transmit Frame-Synchronization Modes
8.15.2 Other Considerations
8.16 Set the Transmit Frame-Synchronization Polarity
8.16.1 Frame Synchronization Pulses, Clock Signals, and Their Polarities
8.17 Set the SRG Frame-Synchronization Period and Pulse Width
8.17.1 Frame-Synchronization Period and Frame-Synchronization Pulse Width
8.18 Set the Transmit Clock Mode
8.18.1 Selecting a Source for the Transmit Clock and a Data Direction for
the CLKX Pin
8.18.2 Other Considerations
8.19 Set the Transmit Clock Polarity
8.19.1 Frame Synchronization Pulses, Clock Signals, and Their Polarities
8.20 Set the SRG Clock Divide-Down Value
8.20.1 Sample Rate Generator Clock Divider
8.21 Set the SRG Clock Synchronization Mode
8.22 Set the SRG Clock Mode (Choose an Input Clock)
8.22.1 SRG Clock Mode
8.23 Set the SRG Input Clock Polarity
8.23.1 Using CLKSP/CLKXP/CLKRP to Choose an Input Clock Polarity
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General-Purpose I/O on the McBSP Pins
10 Emulation, Power, and Reset Considerations
10.1 McBSP Emulation Mode
10.2 Reducing Power Consumed by McBSPs
10.3 Resetting and Initializing McBSPs
10.3.1 McBSP Pin States: OMAP5912 Reset Versus Receiver/Transmitter
Reset
10.3.2 OMAP5912 Reset, McBSP Reset, and Sample Rate Generator Reset
10.3.3 McBSP Initialization Procedure
10.3.4 Resetting the Transmitter While the Receiver is Running
11 Data Packing Examples
11.1
Data Packing Using Frame Length and Word Length
11.2
Data Packing Using Word Length and the Frame-Synchronization
Ignore Function
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OMAP5912
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SPRU762B
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