Table of Contents
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1.1
1.1.1
1.1.2
EMIFF Configuration for OMAP1612 Stacked DDR
1.2
2
2.1
2.1.1
2.1.2
2.1.3
Multiplane Page Program
Restriction in Addressing With Multiplane Page Program
2.1.4
2.1.5
Multiplane Block Erase Operation
Copy-Back Program Operation
2.1.6
Multiplane Copy-Back Program Operation
2.1.7
Read Status and Read Multiplane Status Operations
2.1.8
Reset Operation
2.1.9
Read ID Operation
2.1.10 Error Code Correction
2.1.11 Invalid Block Management
2.1.12 FIFO (Prefetch and Postwrite)
2.1.13 Prefetch
2.1.14 Postwrite
2.1.15 DMA Support
2.1.16 Host Mode
Read Operation
Write Operation
2.1.17 FIFO mode
Prefetch
Postwrite
2.1.18 NAND Flash Memory Core Support
2.1.19 NAND Flash Registers
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