Motorola DSP56305 User Manual page 30

Figure 8-8 SCI Programming Model - Data Registers . . . . . . . . . . . . . . . . . . . . 8-20
Figure 8-9 Port E Control Register (PCRE) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-30
Figure 8-10 Port E Direction Register (PRRE) . . . . . . . . . . . . . . . . . . . . . . . . . . 8-30
Figure 8-11 Port E Data Register (PDRE) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .8-31
Figure 9-1 Timer/Event Counter Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . 9-4
Figure 9-2 Timer/Event Counter Programming Model. . . . . . . . . . . . . . . . . . . . . 9-5
Figure 9-3 Timer Prescaler Load Register (TPLR) . . . . . . . . . . . . . . . . . . . . . . . 9-5
Figure 9-4 Timer Prescaler Count Register (TPCR) . . . . . . . . . . . . . . . . . . . . . . 9-7
Figure 9-5 Timer Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9-9
Figure 9-6 Timer Programming Model. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9-10
Figure 10-1 OnCE Module Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-3
Figure 10-2 OnCE Module Multiprocessor Configuration . . . . . . . . . . . . . . . . . . 10-4
Figure 10-3 OnCE Controller Block Diagram. . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-5
Figure 10-4 OnCE Command Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-5
Figure 10-5 OnCE Status and Control Register (OSCR). . . . . . . . . . . . . . . . . . . 10-8
Figure 10-6 OnCE Memory Breakpoint Logic 0. . . . . . . . . . . . . . . . . . . . . . . . . 10-10
Figure 10-7 OnCE Breakpoint Control Register (OBCR). . . . . . . . . . . . . . . . . . 10-12
Figure 10-8 OnCE Trace Logic Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . 10-15
Figure 10-9 OnCE Pipeline Information and GDB Registers . . . . . . . . . . . . . . 10-19
Figure 10-10 OnCE Trace Buffer. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 10-22
Figure 11-1 TAP Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-4
Figure 11-2 TAP Controller State Machine . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11-6
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