Motorola DSP56305 User Manual page 14

8.3.1.4 Wakeup Mode Select (WAKE) SCR Bit 5. . . . . . . . . . . . 8-10
8.3.1.5 Receiver Wakeup Enable (RWU) SCR Bit 6 . . . . . . . . . 8-11
8.3.1.6 Wired-OR Mode Select (WOMS) SCR Bit 7. . . . . . . . . . 8-11
8.3.1.7 Receiver Enable (RE) SCR Bit 8 . . . . . . . . . . . . . . . . . . 8-11
8.3.1.8 Transmitter Enable (TE) SCR Bit 9 . . . . . . . . . . . . . . . . 8-12
8.3.1.9 Idle Line Interrupt Enable (ILIE) SCR Bit 10. . . . . . . . . . 8-12
8.3.1.10 SCI Receive Interrupt Enable (RIE) SCR Bit 11. . . . . . . 8-13
8.3.1.11 SCI Transmit Interrupt Enable (TIE) SCR Bit 12 . . . . . . 8-13
8.3.1.12 Timer Interrupt Enable (TMIE) SCR Bit 13 . . . . . . . . . . . 8-13
8.3.1.13 Timer Interrupt Rate (STIR) SCR Bit 14 . . . . . . . . . . . . . 8-13
8.3.1.14 SCI Clock Polarity (SCKP) SCR Bit 15. . . . . . . . . . . . . . 8-14
8.3.1.15 SCI Receive with Exception Interrupt Enable
(REIE) SCR Bit 16 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-14
8.3.2 SCI Status Register (SSR) . . . . . . . . . . . . . . . . . . . . . . . . . 8-14
8.3.2.1 Transmitter Empty (TRNE) SSR Bit 0 . . . . . . . . . . . . . . 8-14
8.3.2.2 Transmit Data Register Empty (TDRE) SSR Bit 1 . . . . . 8-14
8.3.2.3 Receive Data Register Full (RDRF) SSR Bit 2. . . . . . . . 8-15
8.3.2.4 Idle Line Flag (IDLE) SSR Bit 3 . . . . . . . . . . . . . . . . . . . 8-15
8.3.2.5 Overrun Error Flag (OR) SSR Bit 4 . . . . . . . . . . . . . . . . 8-15
8.3.2.6 Parity Error (PE) SSR Bit 5. . . . . . . . . . . . . . . . . . . . . . . 8-16
8.3.2.7 Framing Error Flag (FE) SSR Bit 6. . . . . . . . . . . . . . . . . 8-16
8.3.2.8 Received Bit 8 Address (R8) SSR Bit 7 . . . . . . . . . . . . . 8-16
8.3.3 SCI Clock Control Register (SCCR) . . . . . . . . . . . . . . . . . . 8-17
8.3.3.1 Clock Divider (CD[11:0]) SCCR Bits 11-0 . . . . . . . . . . . 8-18
8.3.3.2 Clock Out Divider (COD) SCCR Bit 12. . . . . . . . . . . . . . 8-18
8.3.3.3 SCI Clock Prescaler (SCP) SCCR Bit 13 . . . . . . . . . . . . 8-18
8.3.3.4 Receive Clock Mode Source Bit (RCM) SCCR Bit 14 . . 8-19
8.3.3.5 Transmit Clock Source Bit (TCM) SCCR Bit 15 . . . . . . . 8-20
8.3.4 SCI Data Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-20
8.3.4.1 SCI Receive Registers (SRX). . . . . . . . . . . . . . . . . . . . . 8-21
8.3.4.2 SCI Transmit Registers . . . . . . . . . . . . . . . . . . . . . . . . . 8-21
8.4 OPERATING MODES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-23
8.4.1 SCI After Reset . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-24
8.4.2 SCI Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8-27
8.4.3 SCI Initialization Example . . . . . . . . . . . . . . . . . . . . . . . . . . 8-27
8.4.4 Preamble, Break, and Data Transmission Priority . . . . . . . 8-28
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