Texas Instruments TMS320C6201 Reference Manual page 24

Tables
11–12 Effect of RJUST Values With 12-Bit Example Data ABCh
11–13 Justification of Expanded Data in DRR
11–14 Sample Rate Generator Register (SRGR) Field Summary
11–15 Receive Clock Selection
11–16 Transmit Clock Selection
11–17 Receive Frame Synchronization Selection
11–18 Transmit Frame Synchronization Selection
11–19 Multichannel Control Register Field Descriptions
11–20 Receive/Transmit Channel Enable Register Field Description
11–21 SPI-Mode Clock Stop Scheme
11–22 Configuration of Pins as General Purpose I/O
12–1 Timer Registers
12–2 Timer Control Register Field Descriptions
12–3 Timer GO and HLD Field Operation
12–4 TSTAT Parameters in Pulse and Clock Modes
13–1 TMS320C6201/C6202/C6701 Available Interrupts
13–2 TMS320C6211/C6711 Available Interrupts
13–3 Interrupt Selector Registers
13–4 Default Interrupt Mapping
14–1 Power-Down Mode and Wake-Up Selection
14–2 Characteristics of the Power-Down Modes
14–3 TMS320C6202 Peripheral Power-Down Memory-Mapped Register
14–4 Description of TMS320C6202 Power-Down Control Fields
15–1 14-Pin Header Signal Descriptions
15–2 Emulator Cable Pod Timing Parameters
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