Texas Instruments TMS320C6201 Reference Manual page 23

8-17 Expansion Bus Pin Description (Asynchronous Host Port Mode)
8-18 XARB Bit Value and XHOLD/XHOLDA Signal Functionality
8-19 Possible Expansion Bus Arbitration Scenarios (Internal Bus Arbiter Disabled)
8-20 Description of Expansion Bus Boot Configuration via Pull Up/Pull Down
Resistors on XD[31:0]
9-1 EMIF Signal Descriptions
9-2 EMIF Memory-Mapped Registers
9-3 EMIF Global Control Register Field Descriptions
9-4 EMIF CE Space Control Registers Field Descriptions
9-5 EMIF to SDRAMControlRegisterField Description
9-6 EMIFSDRAM Timing Register Field Descriptions
9-7 TMS320C6211/C6711 SDRAM Extension Register Field Descriptions
9-8 TMS320C6201/C6202/C6701 EMIF SDRAM Commands
9-9 TMS320C6201/C6202/C6701 SDRAM Memory Population
9-10 SDRAM Control Pins
9-11 TMS320C6201/C6202/C6701 Implied SDRAM Configuration by MRS Value
9-12 TMS320C6211/C6711 Implied SDRAM Configuration by MRS
9-13 TMS320C6201/C6202/C6701 Byte Address to EA Mapping for
SDRAM RAS and CAS
9-14 TMS320C6211/C6711 Byte Address to EA Mapping for 32-bit Interface
9-15 TMS320C6201/C6202/C6701 SDRAM Timing Parameters
9-16 SBSRAM in Linear Burst Mode
9-17 EMIF SBSRAM Pins
9-18 EMIF Asynchronous Interface Pins
9-19 Byte Address to EA Mapping for Asynchronous Memory Widths
9-20 TMS320C6201/C6202/C6701 EMIF Prioritization of Requests
9-21 TMS320C6211/C6711 EMIF Prioritization of Requests
10-1 Boot Configuration Summary
10-2 TMS320C6211/C6711 Boot Configuration Summary
10-3 TMS320C6201/C6701 Memory Map Summary
10-4 TMS320C6202 Memory Map Summary
10-5 TMS320C6211/C6711 Memory Map Summary
10-6 DLL Multiplier Select
11-1 McBSP Interface Signals
11-2 McBSP Registers
11-3 TMS320C6211/C6711 Data Receive and Transmit Registers (DRR/DXR) Mapping
11-4 McBSP CPU Interrupts and DMA Synchronization Events
11-5 Serial Port Control Register (SPCR) Field Descriptions
11-6 Pin Control Register (PCR) Field Descriptions
11-7 Receive/Transmit Control Register (RCR/XCR) Field Descriptions
11-8 Reset State of McBSP Pins
11-9 RCR/XCR Fields Controlling Elements per Frame and Bits per Element
11-10 McBSP Receive/Transmit Frame Length 1/2 Configuration
11-11 McBSP Receive/Transmit Element Length Configuration
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Contents
Tables
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