Contents
36.4.1
36.4.2
36.5
36.5.1
36.5.2
36.5.3
36.5.4
36.5.5
36.5.6
36.6
NAND Flash/PC Card controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1571
36.6.1
36.6.2
36.6.3
36.6.4
36.6.5
36.6.6
36.6.7
36.6.8
36.6.9
37
Flexible memory controller (FMC) . . . . . . . . . . . . . . . . . . . . . . . . . . . 1589
37.1
FMC main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1589
37.2
Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1590
37.3
AHB interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1591
37.3.1
37.4
37.4.1
37.4.2
37.4.3
37.5
37.5.1
37.5.2
37.5.3
37.5.4
37.5.5
37.5.6
36/1731
External memory interface signals . . . . . . . . . . . . . . . . . . . . . . . . . . . 1536
General timing rules . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1539
NAND Flash / PC Card supported memories and transactions . . . . . 1574
Timing diagrams for NAND and PC Card . . . . . . . . . . . . . . . . . . . . . 1574
NAND Flash operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1575
Computation of the error correction code (ECC)
in NAND Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1577
PC Card/CompactFlash operations . . . . . . . . . . . . . . . . . . . . . . . . . . 1578
FSMC register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1587
NOR/PSRAM address mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1594
SDRAM address mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1596
General timing rules . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1604
NOR Flash/PSRAM controller asynchronous transactions . . . . . . . . 1604
DocID018909 Rev 11
RM0090
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