Texas Instruments TMS320C6201 Reference Manual page 15

1-1 TMS320C6201/C6202/C6701 Block Diagram
1-2 TMS320C6211/C6711 Block Diagram
2-1 TMS320C6201/C6701 Program Memory Controller in the Block Diagram
2-2 Logical Mapping of Cache Address
2-3 TMS320C6x Block Diagram
2-4 Data Memory Controller Interconnect to Other Banks
(TMS320C6201 Revision 2)
2-5 Data Memory Controller Interconnect to Other Banks
(TMS320C6201 Revision 3)
2-6 Data Memory Controller Interconnect to Other Blocks (TMS320C6701)
2-7 Conflicting Internal Memory Accesses to the Same Block
(TMS320C6201 Revisions 2 and 3)
2-8 Conflicting Internal Memory Accesses to the Same Block (TMS320C6701)
3-1 TMS320C6202 Program Memory Controller Block Diagram
3-2 TMS320C6202 Data Memory Controller Block Diagram
4-1 TMS320C6211/C6711 Block Diagram
4-2 TMS320C6211 Internal Memory Block Diagram
4-3 TMS320C6711 Internal Memory Block Diagram
4-4 L1P Address Allocation
4-5 L1P Direct Mapped Cache Diagram
4-6 L1P Flush Base Address Register Fields (L1PFBAR)
4-7 L1P Flush Word Count Register Fields (L1PFWC)
4-8 L1D Address Allocation
4-9 L1D 2-Way Set Associative Cache Diagram
4-10 L1D Flush Base Address Register Fields (L1DFBAR)
4-11 L1D Flush Word Count Register Fields (L1DFWC)
4-12 Cache Configuration Register Fields (CCFG)
4-13 L2 Memory Configuration
4-14 L2 Cache Data Request Flow Chart
4-15 L2 CE Space Allocation Register Fields
4-16 L2 Flush Register Fields (L2FLUSH)
4-17 L2 Clean Register Fields (L2CLEAN)
4-18 L2 Flush Base Address Register Fields (L2FBAR)
4-19 L2 Flush Word Count Register Fields (L2FWC)
4-20 L2 Clean Base Address Register Fields (L2CBAR)
4-21 L2 Clean Word Count Register Fields (L2CWC)
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Figures
Figures
1 9
1 10
. . . . . . . . . . . . . 2 2
2 5
2 7
2 10
2 12
. . . . . . . . . . . . . 2 14
2 16
. . . . . . . . . . 2 17
3 3
3 7
4 2
4 3
4 4
4 6
4 7
4 8
4 8
4 9
4 11
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Contents xv