Table Of Contents - Texas Instruments TMS320C6201 Reference Manual

8.3.3 XCE Space Control Registers
8.4 Expansion Bus I/O Port Operation
8.4.1 Asynchronous Mode
8.4.2 Synch FIFO Modes
8.4.3 DMA Transfer Examples
8.5 Expansion Bus Host Port Operation
8.5.1 Expansion Bus Host Port Registers Description
8.5.2 Synchronous Host Port Mode
8.5.3 Asynchronous Host Port Mode
8.6 Expansion Bus Arbitration
8.6.1 Internal Bus Arbiter Enabled
8.6.2 Internal Bus Arbiter Disabled
8.6.3 Expansion Bus Requestor Priority
8.7 Boot Configuration Control via Expansion Bus
9 External Memory Interface
Describes the external memory interface (EMIF) that the CPU uses to access off-chip memory.
9.1 Overview
9.2 Resetting the EMIF
9.3 EMIF Registers
9.3.1 Global Control Register
9.3.2 EMIF CE Space Control Registers
9.3.3 EMIF SDRAM Control Register
9.3.4 EMIF SDRAM Timing Register
9.3.5 TMS320C6211/C6711 SDRAM Extension Register
9.4 SDRAM Interface
9.4.1 SDRAM Initialization
9.4.2 Monitoring Page Boundaries
9.4.3 SDRAM Refresh
9.4.4 Mode Register Set
9.4.5 Address Shift
9.4.6 Timing Requirements
9.4.7 SDRAM Deactivation
9.4.8 SDRAM Read
9.4.9 SDRAM Write
9.4.10 TMS320C6211/C6711 Seamless Data Access
9.5 SBSRAM Interface
9.5.1 SBSRAM Reads
9.5.2 SBSRAM Writes
9.6 Asynchronous Interface
9.6.1 TMS320C6201/C6202/C6701 ROM Modes
9.6.2 Programmable ASRAM Parameters
9.6.3 Asynchronous Reads
9.6.4 Asynchronous Writes
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