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A20M - Intel 82496 CACHE CONTROLLER User Manual

Volume 2: 82496 cache controller and 82491 cache sram data book
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HARDWARE INTERFACE
5.2.2.2.
A20M#
A20M#
Address bit 20 Mask
Masks address bit 20.
Input to Pentium processor (pin U05)
Asynchronous
Signal Description
Refer to the Pentium™ Processor Data Book for a detailed description of this signal.
I
5-39

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