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Intel MCS48 User Manual page 330

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PERIPHERAL
BUS
DATA FROM
PERIPHERAL
TO
8255
Figure
30.
MODE
2
(Bidirectional)
NOTE:
Any
sequence
where
W
R
occurs befo
re
ACK
and S
T
B
occu
rs
before
R D
is
permissible.
(INTR
= IBF
•
MASK
•
STB
•
RD
+
OBF
•
MASK
•
ACK
•
WR
)
8-40
00744A

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