Y/C Progressive Display Vertical Timing Example - Texas Instruments TMS320C64x DSP Reference Manual

Dsp video port/vcxo interpolated control (vic) port
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Display Timing Examples
Figure 4–38. Y/C Progressive Display Vertical Timing Example
FLCOUNT
750
1
2
3
4
5
Field 1 Blanking
6
25
Ç Ç Ç Ç Ç Ç Ç
26
27
Field 1 Active
É É É É É É É
Ç Ç Ç Ç Ç Ç Ç
28
29
É É É É É É É
Field 1 Image
É É É É É É É
744
É É É É É É É
Ç Ç Ç Ç Ç Ç Ç
745
746
747
748
749
Field 1 Blanking
750
1
IMGVOFF1 = 3
VBLNKXSTART1 = 1280
IMGVSIZE1 = 716
VBLNKYSTART1 = 746
IMGVOFF2 = n/a
VBLNKXSTOP1 = 1280
IMGVSIZE2 = n/a
VBLNKYSTOP1 = 26
FRMHEIGHT = 750
VBLNKXSTART2 = n/a
VBITSET1 = 746
VBLNKYSTART2 = > 750
VBITCLR1 = 26
VBLNKXSTOP2 = n/a
VBITSET2 = n/a
VBLNKYSTOP2 = > 750
VBITCLR2 = n/a
† Assumes VCT2P bit in VPCTL is set to 1 (active-low output). VSYNC output when VCTL2S bit in VDCTL is set to 00, VBLNK
output when VCTL2S bit is set 01.
§ If DVEN bit in VDCTL is set to 1; otherwise, blanking value is output
4-46
Video Display Port
EAV
ILCOUNT
V F
716
1
0
716
1
0
716
1
0
716
1
0
716
1
0
716
1
0
716
1
0
716
1
0
716
0
0
716
0
0
716
0
0
1
0
0
2
0
0
715
0
0
716
0
0
716
0
0
716
1
0
716
1
0
716
1
0
716
1
0
716
1
0
716
1
0
716
1
0
VSYNCXSTART1 = 1280
VSYNCYSTART1 = 1
VSYNCXSTOP1 = 1280
VSYNCYSTOP1 = 6
VSYNCXSTART2 = n/a
VSYNCYSTART2 = > 750
VSYNCXSTOP2 = n/a
VSYNCYSTOP2 = > 750
Active
Horizontal
Output
Blanking Value
Blanking Value
Blanking Value
Blanking Value
Blanking Value
Blanking Value
Blanking Value
Blanking Value
Default Value §
Default Value §
Default Value §
FIFO Data
FIFO Data
FIFO Data
FIFO Data
Default Value §
Blanking Value
Blanking Value
Blanking Value
Blanking Value
Blanking Value
Blanking Value
Blanking Value
FLD1XSTART = n/a
FLD1YSTART = 1
FLD2XSTART = n/a
FLD2YSTART = > 750
FBITSET = 1
FBITCLR = > 750
SPRU629

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