Texas Instruments OMAP5910 Reference Manual page 12

Figures
37 First-Level Descriptor Address Calculation
38 First-Level Descriptor Format Based on Two Least-Significant Bits
39 Translation for a Virtual Memory Section
40 Second-Level Descriptor Format Based on Two Least-Significant Bits
41 Translation for a Large Page
42 Translation for a Small Page
43 Translation for a Tiny Page
44 Calculating the Descriptor Address in a Coarse Page Table
45 Calculating the Descriptor Address in a Fine Page Table
46 DSP Subsystem External Memory Interface
47 DSP Subsystem External Memory Interface
48 MMU Pre-Fetch Register (PREFETCH_REG)
49 MMU Pre-Fetch Status Register (WALKING_ST_REG)
50 MMU Control Register (CNTL_REG)
51 MMU Fault Address Registers (FAULT_AD_H_REG, FAULT_AD_L_REG)
52 MMU Fault Status Register (FAULT_ST_REG)
53 MMU Interrupt Acknowledge Register (IT_ACK_REG)
54 MMU Translation Table Registers (TTB_H_REG, TTB_L_REG)
55 MMU Lock/Protect Entry Register (LOCK_REG)
56 MMU Read/Write TLB Entry Register (LD_TLB_REG)
57 MMU CAM Entry Registers (CAM_H_REG, CAM_L_REG)
58 MMU RAM Entry Registers (RAM_H_REG, RAM_L_REG)
59 MMU TLB Global Flush Register (GFLUSH_REG)
60 MMU TLB Entry Flush Register (FLUSH_ENTRY_REG)
61 MMU CAM Entry Read Registers (READ_CAM_H_REG, READ_CAM_L_REG)
62 MMU Read RAM Entry Registers (READ_RAM_H_REG, READ_RAM_L_REG)
63 MMU Idle Control Register (DSPMMU_IDLE_CTRL)
64 Conceptual Block Diagram of the DMA Controller Connections
65 High-Level Data Memory Map for DSP Subsystem
66 High-Level I/O Memory Map for DSP Subsystem
67 The Two Parts of a DMA Controller Transfer
68 Registers for Controlling the Context of a Channel
69 DMA Channel Control Register (DMACCR)
70 Auto-Initialization Sequence With Unchanging Context (REPEAT = 1)
71 Auto-initialization Sequence With Changing Context (REPEAT = 0)
72 MPUI Access Configurations
73 One Possible Configuration for the Service Chains
74 Service Chain Applied to Three DMA Ports
75 DSP GDMA Handler
76 Functional Multiplexing DSP DMA Register A (FUNC_MUX_DSP_DMA_A)
77 Functional Multiplexing DSP DMA Register B (FUNC_MUX_DSP_DMA_B)
78 Functional Multiplexing DSP DMA Register C (FUNC_MUX_DSP_DMA_C)
79 Functional Multiplexing DSP DMA Register D (FUNC_MUX_DSP_DMA_D)
80 Triggering a Channel Interrupt Request
12 DSP Subsystem
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