Table of Contents
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CHAPTER 3
vi
Table of Contents
2.7
Data Types. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-8
2.8
Addressing Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-9
2.8.1
Register and Immediate Operands . . . . . . . . . . . . . . . . . . . . . . 2-9
2.8.2
Memory Operands . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2-9
3.1
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-1
3.2
System Design. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-1
3.3
System Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-4
3.4
Initialization and Reset. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-5
3.5
Signal Descriptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-8
3.6
Bus Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-28
3.6.1
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-28
3.6.2
Block Diagrams. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-29
3.6.3
Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-30
3.6.3.1
3.6.3.2
3.6.3.3
3.6.3.4
3.6.3.5
3.6.3.6
3.7
Clock Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-32
3.7.1
Clock Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-32
3.7.2
PLL Bypass Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-34
3.8
Hardware-Related Considerations. . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-34
3.9
Comparison To Other Devices . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-34
3.10 Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-34
4.1
Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1
4.2
System Design. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1
4.2.1
Multiplexed Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1
4.2.2
Emulator Connection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-1
4.3
Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2
4.3.1
Usage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2
4.3.2
Emulator-Related Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2
4.3.2.1
4.3.2.2
4.3.2.3
4.3.2.4
4.3.2.5
4.3.2.6
4.3.2.7
4.3.2.8
4.3.2.9
4.3.2.10
4.3.2.11
4.3.2.12
4.3.2.13
4.3.2.14
4.3.2.15
4.3.2.16
4.3.2.17
4.3.2.18
4.3.2.19
4.3.2.20
4.3.2.21
4.3.2.22
Am186™CC/CH/CU Microcontrollers User's Manual
Address and Data Buses . . . . . . . . . . . . . . . . . . . . . 3-30
Programmable Bus Sizing . . . . . . . . . . . . . . . . . . . . 3-30
Byte Write Enables. . . . . . . . . . . . . . . . . . . . . . . . . . 3-31
Output Enable . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-31
Bus Mastering . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-31
DRAM Controller . . . . . . . . . . . . . . . . . . . . . . . . . . . 3-32
A19-A0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2
AD15-AD0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2
{ADEN} / BHE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-2
ALE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
ARDY and SRDY . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
BHE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
BSIZE8. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
[CAS1-CAS0] and [RAS1-RAS0] . . . . . . . . . . . . . . 4-3
CLKOUT . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
LCS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-3
MCS3-MCS0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4
{ONCE} . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4
QS1-QS0. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4
[RAS1-RAS0] . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4
RD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4
RES . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4
RESOUT . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-4
S2-S0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-5
S6. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-5
SRDY . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-5
UCS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-5
{UCSX8} and WLB . . . . . . . . . . . . . . . . . . . . . . . . . . . 4-5
3-1
4-1
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