Table of Contents
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19
18
17
16
A
D63
D62
D60
BADDR
B
DBG
PWE6
D59
28
BADDR
C
DBB
D61
D58
29
D
BADDR
GBL
PWE5
D57
27
MOD
PSD
E
PSDA
D56
CK1
CAS
10
MOD
F
PWE7
BCTL0
VDD
CK2
MOD
G
POE
TEA
VDDH
CK3
H
ALE
BR
PWE4
VDD
PSDA
J
PWE3
PGTA
VDDH
MUX
K
PWE1
CS2
PWE0
VDDH
L
BCTL1
CS3
CS1
VDD
M
CS4
CS7
CS5
CS0
N
A31
A30
A28
VDDH
P
A29
A27
A23
VDD
R
A25
A24
A19
A15
A22
T
A20
A16
A12
U
A18
A17
A11
A8
A14
V
A9
A13
A6
W
A10
A7
A5
19
18
16
17
Note: Signal names in this figure are the default signals after reset, except for signals C2, C19, D1, D2, D18, E1, F3, H13, H14, and W11 which show the second configuration signal name.
Figure 3-2. MSC8101 Flip Chip Plastic Ball Grid Array (FC-PBGA), Bottom Vie
15
14
13
12
11
D37
D51
D46
D42
D55
D36
D50
D45
D41
D54
D35
D53
D49
D44
D40
D34
D48
D43
D39
D52
VDDH
VDD
VDDH
D47
VDDH
PSD
GND
GND
D38
GND
WE
PSD
D33
VDDH
GND
GND
VAL
BADDR
BADDR
GND
30
31
VDDH
GND
TA
GND
PWE2
GND
GND
CS6
GND
GND
A26
A21
TSIZ3
A1
TT0
TT1
VDDH
GND
GND
GND
GND
GND
VDD
VDDH
VDD
VDDH
VDDH
PA6
A3
TS
AACK
VDDH
SPARE
A4
TT2
TBST
ARTRY
5
BG
ABB
A2
TT3
TSIZ0
INT
TT4
TSIZ2
A0
TSIZ1
_OUT
15
14
13
12
11
Bottom View
10
9
8
7
D32
D22
D27
D17
D31
D21
D26
D16
D30
D25
D20
D15
D29
D19
D24
D14
VDDH
VDD
VDDH
D13
D28
D18
GND
GND
GND
D23
GND
D12
GND
PA30
GND
PC27
PA16
PC6
CLKIN
GND
PD17
PC4
DLL_IN
GND
GND
VDDH
VDD
VDDH
VDDH
CLK
VCC
PC7
PA12
OUT
SYN1
GND
PA8
PA10
PA13
SYN1
GND
PA7
PD7
PA11
HRESET
SYN
VCC
PC5
PA14
PA9
SYN
10
9
8
7
FC-PBGA Package Description
6
5
4
3
2
D11
D7
D4
D1
IRQ5
D10
D6
D3
D0
IRQ3
D9
D5
D2
IRQ4
DP0
THERM
D8
IRQ6
IRQ2
EE0
2
VDDH
VDD
VDDH
EE2
EE3
IRQ7
GND
VDD
EE5
EED
GND
VDDH
TCK
TRST
TMS
TDI
GND
PB31
PC31
PD31
GND
GND
VDD
PC30
PD30
GND
VDDH
PB29
PC29
PD29
GND
GND
VDD
PC28
PB28
PA26
GND
VDDH
PB26
PC26
GND
PC23
VDD
PB25
PA25
GND
PB20
PA23
PB24
PA24
VDDH
PA19
PB18
PA22
SPARE
1
PC14
PC13
PA17
PA20
PB22
RST
NMI
PD16
PD18
PB19
CONF
NMI_
PC12
PC15
PD19
OUT
PO
TEST
SRESET
PA15
PA18
RESET
6
5
4
3
2
1
A
IRQ1
B
THERM
C
1
EE1
D
EE4
E
TDO
F
PA31
G
PB30
H
PA29
J
PA28
K
PA27
L
PB27
M
PC25
N
P
PC24
R
PC22
PB21
T
PA21
U
PB23
V
W
1
3-3
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