Figure 41. SRAM and NOR Flash memory devices - schematic diagram
D[0..15]
D[0..15]
A[0..23]
A[0..23]
U2
A21
E3
A21
A20
H6
A20
A19
G2
A19
A18
H1
A18
A17
D3
A17
A16
E4
G1
A16
I/O15
A15
F4
F1
A15
I/O14
A14
F3
F2
A14
I/O13
A13
G4
E2
A13
I/O12
A12
G3
D2
A12
I/O11
A11
H5
C2
A11
I/O10
A10
H4
C1
A10
I/O9
A9
H3
B1
A9
I/O8
A8
H2
G6
A8
I/O7
A7
D4
F6
A7
I/O6
A6
C4
F5
A6
I/O5
A5
C3
E5
A5
I/O4
A4
B4
D5
A4
I/O3
VDD
A3
B3
C6
A3
I/O2
A2
A5
C5
A2
I/O1
A1
A4
B6
A1
I/O0
R22
A0
A3
A0
R18
10K
A6
CE2
PD7
0
B5
D6
FMC_NE1
CE
VCC
G5
E1
WE
VCC
A2
OE
PE0
A1
D1
FMC_NBL0
BLE
VSS
PE1
B2
E6
FMC_NBL1
BHE
VSS
VDD
VDD
512kx16: IS61WV51216BLL-10MLI
1Mx16: IS61WV102416BLL
R41
R32
2Mx16: CY7C1071DV33-12BAXI
10K
10K
4Mx16: CY62187EV30LL
R43
IS61WV102416BLL-10MLI
PG9
0
FMC_NE2
PD5
FMC_NWE
PD4
FMC_NOE
PD6
FMC_NWAIT
VDD
SRAM
Operating Voltages :
VDD
512x16: IS61WV51216BLL-10MLI VDD: 2.4V to 3.6V
1Mx16: IS61WV102416BLL-10MLI VDD: 2.4V to 3.6V
Default setting: Open
2Mx16: CY7C1071DV33-12BAXI
VDD: 3.0V to 3.6V
4Mx16: CY62187EV30LL
VDD: 2.2V to 3.7V
U5
A23
C8
A23
A22
B8
G7
D15
A22
DQ15A-1
A21
C5
F6
D14
A21
DQ14
A20
D4
G6
D13
A20
DQ13
D15
A19
D5
F5
D12
A19
DQ12
D14
A18
C4
G4
D11
A18
DQ11
D13
A17
B3
F4
D10
A17
DQ10
D12
A16
E7
G3
D9
A16
DQ9
D11
A15
D7
F3
D8
A15
DQ8
D10
A14
C7
E6
D7
A14
DQ7
D9
A13
A7
H6
D6
A13
DQ6
D8
A12
B7
E5
D5
A12
DQ5
D7
A11
D6
H5
D4
A11
DQ4
D6
A10
C6
H4
D3
A10
DQ3
D5
A9
A6
E4
D2
A9
DQ2
D4
A8
B6
H3
D1
A8
DQ1
D3
A7
A3
E3
D0
A7
DQ0
D2
A6
C3
A6
D1
A5
D3
A5
D0
C31 100nF
A4
B2
A4
A3
A2
A3
A2
C2
C20
VDD
A2
A1
D2
100nF
A1
A0
E2
A0
C12 100nF
VDD
A5
W
B5
G5
RP
VCC
A4
F1
RB
VCCQ
R25
G2
D8
G
VCCQ
10K
F2
H2
C40
E
VSS
F7
H7
100nF
BYTE
VSS
B4
E8
Vpp/WP
VSS
M29W128GL70ZA6E
M29W256GL70ZA6E
R28
10K
C30
Nor Flash
100nF
Operating range: 1.65<VDD<3.6V
R133
10K
JP13
Header 2X1
+3V6
VDD
C18
C19
100nF
100nF
Title:
SRAM&Flash
Project:
STM32L476G-EVAL
Size:
A3
Reference:
MB1144
Revision:
B-02
Date:
6/24/2015
Sheet:
10
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