Schedule Of Tables - Xilinx XtremeDSP Spartan-3A DSP 3400A HW-SD3400A-DSP-DB-UNI-G User Manual

Schedule of Tables

Chapter 1: Introduction
UG489 (v2.2) November 17, 2008
Downloaded from Elcodis.com electronic components distributor
Table 1-1: USB/System ACE Interface Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Table 1-2: AC'97 SoundMAX Codec Interface Pin Assignments . . . . . . . . . . . . . . . . . . . . 20
Table 1-3: DVI Interface Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20
Table 1-4: Default Ethernet PHY Configuration. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Table 1-5: Ethernet Interface Pin Assignments. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Table 1-6: Memory Enable Pin Assignment . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
Table 1-7: PS/2 Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Table 1-8: Soft Touch Connector Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Table 1-9: FMC #1 Expansion Connector Pin Assignments (1) . . . . . . . . . . . . . . . . . . . . . . 25
Table 1-10: FMC #1 Expansion Connector Pin Assignments (2) . . . . . . . . . . . . . . . . . . . . . 27
Table 1-11: FMC #2 Expansion Connector Pin Assignments (1) . . . . . . . . . . . . . . . . . . . . . 30
Table 1-12: FMC #2 Expansion Connector Pin Assignments (2) . . . . . . . . . . . . . . . . . . . . . 31
Table 1-13: Reset Connection Pin Assignment . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
Table 1-14: Clock Generator Default Settings. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
Table 1-15: I2C FPGA Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33
Table 1-16: FPGA Fan Controller Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
Table 1-17: FPGA I/O Bank Voltage Rail . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
Table 1-18: FPGA LCD Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
Table 1-19: User-defined Button FPGA Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . 35
Table 1-20: Serial Port FPGA Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Table 1-21: Configuration Jumpers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Table 1-22: User-defined DIP Switch FPGA Pin Assignments . . . . . . . . . . . . . . . . . . . . . . 37
Table 1-23: User-defined LED FPGA Pin Assignments . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Table 1-24: Configuration DIP Switch Functions. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
Table 1-25: Configuration Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
Table 1-26: Status LED Signals. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Table 1-27: Audio Connectors . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Table 1-28: FPGA DDR2 Interface Pin Assignments. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
Table 1-29: I2C Slave Device Addresses. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
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