Texas Instruments TMS320C6000 Reference Manual page 6

Contents
4.6 Clocking and Framing Examples
4.6.1 Multiphase Frame Example: AC97
4.6.2 Double-Rate ST-BUS Clock
4.6.3 Single-Rate ST-BUS Clock
4.6.4 Double-Rate Clock
5 McBSP Standard Operation
5.1 Receive Operation
5.2 Transmit Operation
5.3 Maximum Frame Frequency
5.4 Frame Synchronization Ignore
5.4.1 Frame Sync Ignore and Unexpected Frame Sync Pulses
5.4.2 Data Packing using Frame Sync Ignore Bits
5.5 Serial Port Exception Conditions
5.5.1 Receive Overrun: RFULL
5.5.2 Unexpected Receive Frame Synchronization: RSYNCERR
5.5.3 Transmit With Data Overwrite
5.5.4 Transmit Empty: XEMPTY
5.5.5 Unexpected Transmit Frame Synchronization: XSYNCERR
6 m-Law/A-Law Companding Hardware Operation
6.1 Companding Internal Data
6.2 Bit Ordering
7 McBSP Initialization Procedure
7.1 General Initialization Procedure
7.2 Special Case: External Device is the Transmit Frame Master
8 Multichannel Selection Operation
8.1 Enabling Multichannel Selection
8.2 Enabling and Masking of Channels in Normal Multichannel Selection Mode
8.2.1 Changing Element Selection
8.2.2 End-of-Subframe Interrupt
8.3 Enhanced Multichannel Selection Mode (C64x DSP only)
8.4 DX Enabler: DXENA
9 SPI Protocol: CLKSTP
9.1 McBSP Operation as the SPI Master
9.2 McBSP Operation as the SPI Slave
9.3 McBSP Initialization for SPI Mode
10 McBSP Pins as General-Purpose I/O
6 Multichannel Buffered Serial Port (McBSP)
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SPRU580C
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