Texas Instruments TMS320C6000 Reference Manual page 8

Figures
Figures
1 McBSP Block Diagram
2 Frame and Clock Operation
3 Clock and Frame Generation
4 Receive Data Clocking
5 Transmit Data Clocking
6 Sample Rate Generator
7 CLKG Synchronization and FSG Generation When GSYNC = 1 and CLKGDV = 1
8 CLKG Synchronization and FSG Generation When GSYNC = 1 and CLKGDV = 3
9 Programmable Frame Period and Width
10 Dual-Phase Frame Example
11 Single-Phase Frame of Four 8-Bit Elements
12 Single-Phase Frame of One 32-Bit Element
13 Data Delay . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
14 2-Bit Data Delay Used to Discard Framing Bit
15 AC97 Dual-Phase Frame Format
16 AC97 Bit Timing Near Frame Synchronization
17 Double-Rate ST-BUS Clock Example
18 Single-Rate ST-BUS Clock Example
19 Double-Rate Clock Example
20 McBSP Standard Operation
21 Receive Operation
22 Transmit Operation
23 Maximum Frame Frequency for Transmit and Receive
24 Unexpected Frame Synchronization With (R/X)FIG = 0
25 Unexpected Frame Synchronization With (R/X)FIG = 1
26 Maximum Frame Frequency Operation With 8-Bit Data
27 Data Packing at Maximum Frame Frequency With (R/X)FIG = 1
28 Serial Port Receive Overrun
29 Serial Port Receive Overrun Avoided
30 Decision Tree Response to Receive Frame Synchronization Pulse
31 Unexpected Receive Synchronization Pulse
32 Transmit With Data Overwrite
33 Transmit Empty
34 Transmit Empty Avoided
35 Decision Tree Response to Transmit Frame Synchronization Pulse
8 Multichannel Buffered Serial Port (McBSP)
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SPRU580C
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