Texas Instruments TMS320C6000 Reference Manual page 6

Figures
Figures
1 14-Pin Header Signals and Header Dimensions
2 JTAG Emulator Cable Pod Interface
3 JTAG Emulator Cable Pod Timing Diagram
4 Target-System-Generated Test Clock
5 Multiprocessor Connections
6 Pod/Connector Dimensions
7 14-Pin Connector Dimensions
8 Connecting a Secondary JTAG Scan Path to an SPL
9 EMU0/1 Configuration
10 EMU0/1 Configuration With Additional AND Gate to Meet Timing Requirements
11 Suggested Timings for the EMU0 and EMU1 Signals
12 EMU0/1 Configuration Without Global Stop
13 TBC Emulation Connections for n JTAG Scan Paths
Tables
1 14-Pin Header Signal Descriptions
2 Emulator Cable Pod Timing Parameters
30 Designing for JTAG Emulation
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