Table Of Contents - Xilinx 7 Series User Manual

Table of Contents

Revision History
Preface: About This Guide
Guide Contents
Additional Support Resources
Chapter 1: Overview
CLB Overview
7 Series CLB Features
Device Resources
Recommended Design Flow
Pinout Planning
Chapter 2: Functional Details
CLB Arrangement
Slice Description
Look-Up Table (LUT)
Storage Elements
Distributed RAM (Available in SLICEM Only)
Shift Registers (Available in SLICEM Only)
Multiplexers
Carry Logic
Chapter 3: Design Entry
Design Checklist
Using the CLB Resources
Primitives
Chapter 4: Applications
Distributed RAM Applications
Shift Register Applications
Carry Logic Applications
Chapter 5: Timing
CLB General Slice Timing Model and Parameters
CLB Slice Multiplexer Timing Model and Parameters
CLB Slice Carry-Chain Timing Model and Parameters
7 Series FPGAs CLB User Guide
UG474 (v1.8) September 27, 2016
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