Table of Contents
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iCE40HX-8K Breakout Board
Evaluation Board User Guide
5
DNI
DNI
DNI
DNI
+3.3V
VCCIO0
TP4
TP4
TP5
TP5
R21
R21
1
1
C14
C14
C17
C17
C18
C18
0.1uF
0.1uF
0.1uF
0.1uF
0.1uF
0.1uF
D
DNI
DNI
DNI
DNI
+1.2V
TP6
TP6
TP7
TP7
R23
R23
100
100
C22
C22
10uF
10uF
C
B
A
5
© 2013-2020 Lattice Semiconductor Corp. All Lattice trademarks, registered trademarks, patents, and disclaimers are as listed at www.latticesemi.com/legal.
All other brand or product names are trademarks or registered trademarks of their respective holders. The specifications and information herein are subject to change without notice.
14
4
U3A
U3A
iCE40HX8K-CT256
iCE40HX8K-CT256
A13
C14
VCCIO0_01
PIO0_00
A3
B15
PIO0_01
VCCIO0_02
PIO0_01
C15
C15
A8
D13
VCCIO0_03
PIO0_02
F8
B14
PIO0_03
VCCIO0_04
PIO0_03
C12
0.1uF
0.1uF
PIO0_04
E11
PIO0_05
C13
PIO0_06
A16
PIO0_07
PIO0_07
A15
PIO0_08
PIO0_08
B13
PIO0_09
PIO0_09
E10
PIO0_10
E8
C11
PLLVCC0
PIO0_11
E7
D11
PLLGND_0
PIO0_12
C23
C23
B12
PIO0_13
PIO0_13
B10
PIO0_14
PIO0_14
0.1uF
0.1uF
B11
PIO0_15
PIO0_15
C10
PIO0_16
A10
PIO0_17
PIO0_17
A11
PIO0_18
PIO0_18
D10
PIO0_19
C9
PIO0_20
PIO0_20
E9
PIO0_21
D9
PIO0_22
A9
PIO0_23
PIO0_23
F9
PIO0_24
B9
PIO0_27
BANK0
BANK0
PIO0_27
D8
PIO0_28
B8
PIO0_29
PIO0_29
A7
PIO0_30
PIO0_30
C7
PIO0_31
PIO0_31
B7
PIO0_32
PIO0_32
B6
PIO0_33
PIO0_33
C6
PIO0_34
PIO0_34
D7
PIO0_35
A6
PIO0_36
PIO0_36
D6
PIO0_37
A5
PIO0_38
PIO0_38
B5
PIO0_39
PIO0_39
E6
PIO0_40
B4
PIO0_41
PIO0_41
A2
PIO0_42
PIO0_42
D5
PIO0_43
A1
PIO0_44
PIO0_44
C5
PIO0_45
PIO0_45
C4
PIO0_46
PIO0_46
B3
PIO0_47
PIO0_47
D4
PIO0_48
E5
PIO0_49
F7
D3
GBIN0/PIO0_26
PIO0_50
C8
C3
PIO0_51
GBIN1/PIO0_25
PIO0_51
VCCIO0
MAKE PWR TRACES
CAPABLE OF 1A
C25
C25
J1
J1
0.1uF
0.1uF
2
1
PIO0_07
4
3
PIO0_01
PIO0_08
PIO0_03
6
5
PIO0_09
8
7
PIO0_15
10
9
PIO0_13
PIO0_14
12
11
PIO0_18
PIO0_20
14
13
PIO0_17
16
15
18
17
PIO0_27
PIO0_23
PIO0_30
20
19
PIO0_29
PIO0_31
22
21
PIO0_32
24
23
PIO0_34
26
25
PIO0_36
PIO0_45
28
27
PIO0_33
PIO0_46
30
29
PIO0_38
32
31
PIO0_51
34
33
PIO0_39
PIO0_47
36
35
PIO0_41
PIO0_44
38
37
PIO0_42
40
39
Header2x20
Header2x20
DNI
DNI
4
3
DNI
DNI
DNI
DNI
+3.3V
VCCIO1
TP8
TP8
TP9
TP9
R22
R22
DCDn
2
1
1
C21
C21
DSRn
2
0.1uF
0.1uF
2
DTRn
CTSn
2
2
RTSn
RS232_Tx_TTL
2
2
RS232_Rx_TTL
LED0
5
LED1
5
LED2
5
LED3
5
LED4
5
LED5
5
LED6
5
LED7
5
VCCIO1
VCC_1.2V
MAKE PWR TRACES
CAPABLE OF 1A
C24
C24
J2
J2
0.1uF
0.1uF
2
1
PIO1_01
4
3
PIO1_03
6
5
8
7
PIO1_14
10
9
PIO1_16
12
11
PIO1_21
14
13
16
15
PIO1_22
18
17
PIO1_42
20
19
PIO1_29
22
21
24
23
PIO1_32
26
25
PIO1_36
28
27
PIO1_46
30
29
32
31
PIO1_44
34
33
PIO1_51
36
35
PIO1_49
38
37
40
39
Header2x20
Header2x20
3
Figure A.3. FPGA
2
1
U3B
U3B
iCE40HX8K-CT256
iCE40HX8K-CT256
H10
P16
VCCIO1_01
PIO1_04
C15
M13
VCCIO1_02
PIO1_05
C19
C19
C16
C16
C20
C20
H15
M14
VCCIO1_03
PIO1_06
N15
L12
VCCIO1_04
PIO1_07
0.1uF
0.1uF
0.1uF
0.1uF
0.1uF
0.1uF
N16
PIO1_08
L13
PIO1_09
L14
PIO1_10
K12
PIO1_11
M16
PIO1_12
J10
PIO1_13
M15
PIO1_14
J11
PIO1_15
R14
L16
PIO1_00
PIO1_16
PIO1_01
R15
K13
PIO1_01
PIO1_17
P14
K14
PIO1_02
PIO1_18
PIO1_03
P15
J15
PIO1_03
PIO1_19
N14
K15
TRST_B
PIO1_20
K16
PIO1_21
J14
PIO1_22
R24
R24
J12
PIO1_23
J13
PIO1_24
10K
10K
J16
PIO1_25
H13
PIO1_26
BANK1
BANK1
H14
PIO1_29
G16
PIO1_30
H12
PIO1_31
G15
PIO1_32
G10
PIO1_33
F16
PIO1_34
G11
PIO1_35
F15
PIO1_36
G14
PIO1_37
E16
PIO1_38
G13
PIO1_39
D16
PIO1_40
G12
PIO1_41
F14
PIO1_42
F12
PIO1_43
D15
PIO1_44
F11
PIO1_45
E14
PIO1_46
C16
PIO1_47
F13
PIO1_48
B16
PIO1_49
GBIN2/PIO1_28
H16
E13
GBIN2/PIO1_28
PIO1_50
H11
D14
GBIN3/PIO1_27
PIO1_51
C26
C26
C27
C27
0.1uF
0.1uF
0.1uF
0.1uF
PIO1_04
PIO1_08
PIO1_12
PIO1_20
PIO1_18
PIO1_37
PIO1_19
GBIN2/PIO1_28
PIO1_30
PIO1_34
PIO1_38
PIO1_40
PIO1_47
AXELSYS
AXELSYS
AXELSYS
Title
Title
Title
iCE40-HX8K Breakout Board - FPGA
iCE40-HX8K Breakout Board - FPGA
iCE40-HX8K Breakout Board - FPGA
S
S
S
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D
D
D
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c
c
c
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b
b
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B
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ICE40HX8K-B-EVN
ICE40HX8K-B-EVN
ICE40HX8K-B-EVN
D
D
D
t a
t a
t a
: e
: e
: e
Jul 27, 2013
Jul 27, 2013
Jul 27, 2013
S
S
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h
h
h
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2
1
PIO1_04
PIO1_08
D
PIO1_12
PIO1_14
PIO1_16
PIO1_18
PIO1_19
PIO1_20
PIO1_21
PIO1_22
PIO1_29
PIO1_30
PIO1_32
PIO1_34
C
PIO1_36
PIO1_37
PIO1_38
PIO1_40
PIO1_42
PIO1_44
PIO1_46
PIO1_47
PIO1_49
PIO1_51
B
A
R
R
R
e
e
e
v
v
v
A
A
A
3
3
3
of
of
of
6
6
6
FPGA-EB-02031-1.2
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