Table of Contents
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FPGA U1 200 MHz 2.5V LVDS Oscillator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
FPGA U2 PROG Push Button, INIT LED and DONE LED . . . . . . . . . . . . . . . . . . . . . . 21
FPGA U2 User LEDs, DIP and Pushbutton Switches . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
FPGA U2 User DIP Switches (Active High) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
User Push Buttons (Active High) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
FPGA U2 User GPIO Header . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
FPGA U2 USB to UART Bridge . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23
FPGA U2 200 MHz 2.5V LVDS Oscillator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 24
FPGA U1 FCI Airmax Interlaken Connectors . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25
FPGA U1 FCI J3 RX Reference Clock to SMA Connection . . . . . . . . . . . . . . . . . . . . . . 32
FPGA U2 FCI Airmax Interlaken Connectors . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32
PGA U2 FCI J4 RX Reference Clock to SMA Connection . . . . . . . . . . . . . . . . . . . . . . . 35
FPGA U1 GTX to FPGA U2 GTX Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
FPGA U1 and U2 Differential SMA Clock Inputs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Differential 2.5V Si570 LVDS Oscillators . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
Differential SN65LVCP408PAP 8X8 Crosspoint switches . . . . . . . . . . . . . . . . . . . . . . . 43
FPGA U1 Differential SMA Test Clock Inputs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
FPGA U2 Differential SMA Test Clock Inputs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
FPGA U1 and U2 Si570 with 1-to-6 Clock Buffer (Two Circuits) . . . . . . . . . . . . . . . . . 45
FPGA U1 and U2 Example GTH Clock Routing Example . . . . . . . . . . . . . . . . . . . . . . 47
FMC HPC Connectors . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51
System Monitor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
2
I
C Bus Management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61
ML630 FCI Airmax Interlaken Plug
and Receptacle Level-Shifted Control Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64
FPGA U1 VGA Debug Connector . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65
FPGA U2 VGA Debug Connector . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 66
Appendix A: Default Jumper Positions
Appendix B: VITA 57.1 FMC HPC Connector Pinout
Appendix C: ML630 Master UCF Listing for U1
Appendix D: ML630 Master UCF Listing for U2
Appendix E: ML630C Schematic Page List
Appendix F: Documents and Resources
Documents
Webpages
Product Support
4
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References
80 LVDS Pair Connection FPGA U1 to FPGA U2
Setup of U1 and U2 GTH Bank 106 and 107 Clocks
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ML630 Board User Guide
UG828 (v1.0) September 28, 2011
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