Table of Contents
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Instruction List (4)
Mnemonic
Classification
Opcode
ld.a
[%rb], %rs
32-bit data transfer
[%rb]+, %rs
[%rb]-, %rs
-[%rb], %rs
[%sp+imm7], %rs
[imm7], %rs
%rd, %sp
%rd, %pc
%rd, [%sp]
%rd, [%sp]+
%rd, [%sp]-
%rd, -[%sp]
[%sp], %rs
[%sp]+, %rs
[%sp]-, %rs
-[%sp], %rs
%sp, %rs
%sp, imm7
sld.a
%rd, imm20
%sp, imm20
%rd, symbol±imm20
%sp, symbol±imm20
%rd, [%sp+imm20]
%rd, [imm20]
[%sp+imm20], %rs
[imm20], %rs
xld.a
%rd, imm24
%sp, imm24
%rd, symbol±imm24
%sp, symbol±imm24
%rd, [%sp+imm24]
%rd, [imm24]
[%sp+imm24], %rs
[imm24], %rs
Remarks
Operand
A[rb](23:0)←rs(23:0), A[rb](31:24)←0
A[rb](23:0)←rs(23:0), A[rb](31:24)←0, rb(23:0)←rb(23:0)+4
A[rb](23:0)←rs(23:0), A[rb](31:24)←0, rb(23:0)←rb(23:0)-4
rb(23:0)←rb(23:0)-4, A[rb](23:0)←rs(23:0), A[rb](31:24)←0
A[sp+imm7](23:0)←rs(23:0), A[sp+imm7](31:24)←0
A[imm7](23:0)←rs(23:0), A[imm7](31:24)←0
rd(23:2)←sp(23:2), rd(1:0)←0
rd(23:0)←pc(23:0)+2
rd(23:0)←A[sp](23:0), ignored←A[sp](31:24)
rd(23:0)←A[sp](23:0), ignored←A[sp](31:24), sp(23:0)←sp(23:0)+4
rd(23:0)←A[sp](23:0), ignored←A[sp](31:24), sp(23:0)←sp(23:0)-4
sp(23:0)←sp(23:0)-4, rd(23:0)←A[sp](23:0), ignored←A[sp](31:24)
A[sp](23:0)←rs(23:0), A[sp](31:24)←0
A[sp](23:0)←rs(23:0), A[sp](31:24)←0, sp(23:0)←sp(23:0)+4
A[sp](23:0)←rs(23:0), A[sp](31:24)←0, sp(23:0)←sp(23:0)-4
sp(23:0)←sp(23:0)-4, A[sp](23:0)←rs(23:0), A[sp](31:24)←0
sp(23:2)←rs(23:2)
sp(6:2)←imm7(6:2), sp(23:7)←0
%rd←imm20
%sp←imm20
%rd←symbol±imm20(19:0)
%sp←symbol±imm20(19:0)
%rd←A[%sp+imm20](23:0), ignored←A[%sp+imm20](31:24)
%rd←A[imm20](23:0), ignored←A[imm20](31:24)
A[%sp+imm20](23:0)←%rs(23:0), A[%sp+imm20](31:24)←0
A[imm20](23:0)←%rs(23:0), A[imm20](31:24)←0
%rd←imm24
%sp←imm24
%rd←symbol±imm24(23:0)
%sp←symbol±imm24(23:0)
%rd←A[%sp+imm24](23:0), ignored←A[%sp+imm24](31:24)
%rd←A[imm24](23:0), ignored←A[imm24](31:24)
A[%sp+imm24](23:0)←%rs(23:0), A[imm24](31:24)←0
A[imm24](23:0)←%rs(23:0), A[%sp+imm24](31:24)←0
Function
Assembly Programming
Flags
D
IL IE
C
V
Z
N
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○
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○
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