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3.1.1.1.4
Operation Modes
Operation Mode
# of separate power rails
R116
R143
PWR
R144
R200
R100
Sync
R101
R102
R103
Comp
R104
R105
R107
Vsns
R108
R109
R117
En
R118
R119
R128
SS
R129
R130
R220
R225
R229
R226
R230
R227
Individual
R231
Inverters
R228
R232
R221
R222
R223
R224
R211
R216
Hex
R217
Inverter
R218
R219
TIDUEN1A – December 2018 – Revised August 2019
Submit Documentation Feedback
Table 4. Operation Modes
Variant 002 –
Variant 001 –
Quadrature
Quadrature
operation
operation 555
external clock
timer
used
1
1
Y
Y
Y
Y
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
Y
Y
Y
Y
Y
Y
Y
Y
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
3- to 7-VIN, 24-A IOUT, 0.95-VOUT, Space-Grade Current Sharing Point-of-
Copyright © 2018–2019, Texas Instruments Incorporated
Hardware, Software, Testing Requirements, and Test Results
Variant 004 –
Variant 003 –
Two parallel
Parallel
master slave
operation
two
master slave
individually
synchronized
2
3
Y
Y
Y
Y
DNP
DNP
DNP
DNP
Y
Y
DNP
DNP
Y
DNP
Y
Y
DNP
DNP
Y
DNP
Y
Y
DNP
DNP
Y
DNP
Y
Y
DNP
DNP
Y
DNP
Y
Y
DNP
DNP
Y
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Y
Variant 005 –
Variant 006 –
All Individual
All Individual
rails external
rails external
clock
clock
synchronized
synchronized
180° phase
selectable
shift
phase shift
4
4
Y
Y
Y
Y
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
DNP
Y
DNP
DNP
DNP
Y
DNP
DNP
DNP
Y
DNP
DNP
DNP
Y
DNP
DNP
DNP
Y
DNP
Y
Y
Y
Y
Y
Y
Y
Y
Y
DNP
Y
DNP
Y
DNP
Y
DNP
Y
DNP
Load (POL) Reference Design
13
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