AMD Am79C930 Preliminary Manual page 9

LED Support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
RESET Methods
RESET Pin . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
SWRESET (SIR0[7])
CORESET (SIR0[6])
PCMCIA COR SRESET
ISA PnP RESET
SRES (TIR0[5])
REGISTER DESCRIPTIONS
System Interface Registers (SIR space)
SIR0: General Configuration Register (GCR)
SIR1: Bank Switching Select Register (BSS)
SIR2: Local Memory Address Register [7:0] (LMA)
SIR3: Local Memory Address Register [14:8] (LMA)
SIR4: I/O Data Port A (IODPA)
SIR5: I/O Data Port B (IODPB)
SIR6: I/O Data Port C (IODPC)
SIR7: I/O Data Port D (IODPD)
MAC Interface Registers (MIR Space)
MIR0: Processor Interface Register (PIR)
MIR1: Power Up Clock Time [3:0] (PUCT)
MIR2: Power Down Length Count [7:0] (PDLC)
MIR3: Power Down Length Count [15:8] (PDLC)
MIR4: Power Down Length Count [22:16] (PDLC)
MIR5: Free Count [7:0] (FCNT)
MIR6: Free Count [15:8] (FCNT)
MIR7: Free Count [23:16] (FCNT)
MIR8: Flash Wait States
MIR9: TCR Mask STSCHG Data
MIR10: Reserved
MIR11: Reserved
MIR12: Reserved
MIR13: Reserved
MIR14: Reserved
MIR15: Reserved
Transceiver Attachment Interface Registers (TIR Space)
TIR0: Network Control
TIR1: Network Status
TIR2: Serial Device
TIR3: Fast Serial Port Control
TIR4: Interrupt Register 1
TIR5: Interrupt Register
TIR6: Interrupt Unmask Register 1
TIR7: Interrupt Unmask Register 2
TIR8: Transmit Control
TIR9: Transmit Status
P R E L I M I N A R Y
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Am79C930
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AMD
73
73
73
73
74
74
75
75
75
76
77
78
79
79
79
80
80
80
80
80
81
81
81
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82
82
82
82
83
85
85
85
85
85
85
86
89
89
90
91
91
92
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93
94
94
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