AMD Am79C930 Preliminary Manual page 10

AMD
TIR10: TX FIFO Data Register
TIR11: Transmit Sequence Control
TIR12: Byte Count Register LSB
TIR13: Byte Count Register MSB
TIR14: Byte Count Limit LSB
TIR15: Byte Count Limit MSB
TIR16: Receiver Control
TIR17: Receive Status Register
TIR18: RX FIFO Data Register
TIR19: Reserved
TIR20: CRC32 Correct Byte Count LSB
TIR21: CRC32 Correct Byte Count MSB
TIR22: CRC8 Correct Byte Count LSB
TIR23: CRC8 Correct Byte Count MSB
TIR24: TCR Index Register
TIR25: Configuration Data Port
TIR26: Antenna Diversity and A/D Control
TIR27: Serial Approximation Register
TIR28: RSSI Lower Limit
TIR29: USER Pin Data
TIR30: Test Dummy Register
TIR31: TEST
TAI Configuration Register space (TCR)
TCR0: Network Configuration
TCR1: Transmit Configuration
TCR2: Clock Recovery
TCR3: Receive Configuration
TCR4: Antenna Diversity Timer
TCR5: TX Ramp Up Timing
TCR6: TX Ramp Down Timing
TCR7: Pin Data A
TCR8: Start Delimiter LSB
TCR9: Start Delimiter CSB
TCR10: Start Delimiter MSB
TCR11: Interrupt Register 3
TCR12: Interrupt Unmask Register 3
TCR13: Pin Configuration A
TCR14: Pin Configuration B
TCR15: Pin Configuration C
TCR16: Baud Detect Start
TCR17: Baud Detect Lower Limit
TCR18: Baud Detect Upper Limit.
TCR19: Baud Detect Accept Count for Carrier Sense
TCR20: Baud Detect Accept Count for Stop Diversity
TCR21: Baud Detect Ratio
TCR22: Baud Detect Accept Count
TCR23: Baud Detect Fail Count
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P R E L I M I N A R Y
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