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SCHEMATIC DIAGRAM-12
A
MAIN TG CIRCUIT
SDOE[0-3]
SDIE[0-3]
BCKX
J
LRCKX
I
MTMG
H
BCK
G
LRCK
F
SDI
E
SDO0
D
SDO1
C
SDO2
B
CKOUT
A
KB0-KS3
CN201
A19
1
T
A18
2
S
A17
3
R
A16
4
Q
A15
5
P
A14
6
O
A13
7
N
A12
8
M
A11
9
L
A10
10
K
A9
11
J
A8
12
I
A7
13
H
A6
14
G
A5
15
F
A4
16
E
A3
17
D
A2
18
C
A1
19
B
E
20
E
21
D16
22
Q
D17
23
R
D18
24
S
D19
25
T
D20
26
U
D21
27
V
D22
28
W
D23
29
X
D24
30
Y
D25
31
Z
D26
32
a
D27
33
b
D28
34
c
D29
35
d
D30
36
e
D31
37
f
EXP.CS0
38
WE2
39
RE
40
CN202
A19
1
T
A18
2
S
A17
3
R
A16
4
Q
A15
5
P
A14
6
O
A13
7
N
A12
8
M
A11
9
L
A10
10
K
A9
11
J
A8
12
I
A7
13
H
A6
14
G
A5
15
F
A4
16
E
A3
17
D
18
A2
C
A1
19
B
E
20
E
21
D16
22
Q
D17
23
R
D18
24
S
D19
25
T
D20
26
U
D21
27
V
D22
28
W
D23
29
X
D24
30
Y
D25
31
Z
D26
32
a
D27
33
b
D28
34
c
D29
35
d
D30
36
e
D31
37
f
EXP.CS1
38
WE2
39
RE
40
EXP.CS1
EXP.CS0
A[0-25]
D[0-31]
RE
WE2
TGCS
LORST
A
B
C
D
E
F
G
H
I
J
K
L
M
ZC201
ZC202
ZC203
47Px4
47Px4
47Px4
Z204
4.7Kx8
R201
47
Z201
47x4
Z202
47x4
Z203
47x4
C201
47P
+3.3D
+3.3D
C206
0.1
20
VCC
IC202
1
OE1
TC74LCX541F
19
OE2
8 BIT OCTAL
BUS BUFFER
9
7
7
11
6
6
8
12
7
5
5
13
8
4
4
14
A
Y
5
3
3
15
2
2
4
16
1
1
3
17
2
0
0
18
GND
10
Z205
4.7Kx4
Z206
4.7Kx4
R203
1M
R202
X201
47
16.93MHz
C207
C208
10P
10P
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