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6-1-13. MAIN, GATE ARRAY SPPS, VM200 (13/15)
PLL+5
C332
SYS_LRCK
0.01
[DIF]
SYS_LRCK
C331
R321
10/16
1.5k
1
2
R322
3
220k
4
5
R323
C334
6
C336
100
15p
7
0.01
C335
8
0.47
PLLGND
[DSP]
/+48_ON
R306
D+5
10k
/FULL_EQ
[DSP]
/FULL_EQ
D+5
D+3.3
1
VDD
2
VSS
3
UVDD
D0
4
D0
D1
5
D1
D2
6
D2
D3
7
D3
8
VSS
D4
9
D4
D5
10
D5
D6
11
D6
D7
12
D7
D8
13
D8
D9
14
D9
15
U301
VSS
D10
16
GA_SPPS
D10
D11
17
D11
D12
18
D12
D13
19
D13
D14
20
D14
D15
21
D15
D16
22
D16
D17
23
D17
D18
24
D18
D19
25
D19
D20
26
D20
27
UVDD
28
VSS
29
UVDD
D21
30
D21
DGND
A[0..19]
[CPU]
A[0..19]
/CS5
[CPU]
/CS5
/CS6
[CPU]
/CS6
/RD
[CPU]
/RD
/WR
[CPU]
/WR
/RST_3V
[VC]
/RST_3V
L301
C333
22µH
0.1
X2
22.5792MHz
U303
PLLGND
R331
TC9246F
1M
16
REF
VDD
15
PD
LOCK
U304A
14
VDDA
S2
74VHCU04(5V)
13
AMPI
S1
12
1
2
R324
AMPO
M2
11
330
VSSA
M1
10
XI
CKO
9
C342
C343
XO
VSS
22p
22p
DGND
DGND
C906
DGND
0.1
SYS_256FS
R302
R305
100x4
330
1
2
MSCK
MSCK
BCK
3
4
BCK
5
6
LRCK
LRCK
WORD_INT
7
8
WORD_INT
R301
100x4
80
1
2
MON_D
SOUT_67
[DSP]
MON_D
AUX34_D
79
3
4
SOUT_45
AUX34_D
[DSP]
78
5
6
AUX12_D
VSS
[DSP]
AUX12_D
77
7
8
FXS_D
SOUT_23
FXS_D
[DSP]
76
SOUT_01
75
FXR_D0
SIN_89
[DSP]
FXR_D0
POST_EQ_D3
74
SIN_67
73
VDD
72
POST_EQ_D2
SIN_45
71
POST_EQ_D1
SIN_23
70
POST_EQ_D0
SIN_01
69
/MUTE
68
/TRP
D+5
67
PCMBW1
66
VSS
65
PCMBW0
R303
R307
64
C5VOUT2
0
1k
63
SCK_DSP
C5VOUT1
RXD_DSP
62
C3VIN1
61
UVDD
R303
60
CTL_RIN
0
59
/RESET
RXD2_3V
58
C3VOUT1
57
C5VIN2
R304 100
SCKDSP_3V
56
C5VIN1
55
A0
A0
54
A1
A1
53
UVDD
52
UVDD
51
A2
A2
C321
100p
DGND
D[0..31]
[DSP] POST_EQ_D[0..7]
U304C
74VHCU04(5V)
5
6
U304B
C341
74VHCU04(5V)
3
4
512FS
9
8
DGND
R332
U304D
330
74VHCU04(5V)
DGND
/PD_DSP
[DIF]
[DSP]
/PD_DSP
[DIF]
[DIF]
[DIF]
R109
C313
C319
D+5
DGND
10k
0.01
0.01
C311
10/16
C312
C318
D+5
DGND
0.01
0.01
C317
C314
10/16
0.01
C315
C316
DGND
1
0.01
0.01
2
3
D0
4
D1
5
D2
6
D3
7
8
D4
9
D5
10
D6
11
D7
12
D8
13
D9
14
15
GA_SPPS
D10
16
D11
17
D12
18
[DSP]
SCK_DSP
D13
19
RXD_DSP
[J11-3]
D14
20
D15
21
D16
22
D17
23
RXD2_3V
D18
24
D19
25
SCKDSP_3V
[CPU]
D20
26
27
28
29
D21
30
D+5
D+5
14
C301
VCC
DGND
10/16
0.01
7
GND
D+3.3
U102E
U304G
74VHCT04(5V)
74VHCU04(5V)
10
11
C304
DGND
10/16
1
2
3
4
5
6
7
8
R312
100x4
R311
100x4
80
1
2
ADAT_D3
SOUT_67
79
3
4
ADAT_D2
SOUT_45
78
5
6
ADAT_D1
VSS
77
7
8
ADAT_D0
SOUT_23
76
SOUT_01
75
FXR_D1
SIN_89
POST_EQ_D7
74
SIN_67
73
VDD
72
POST_EQ_D6
SIN_45
71
POST_EQ_D5
SIN_23
70
POST_EQ_D4
SIN_01
69
/MUTE
68
R315
/TRP
67
100x4
U302
PCMBW1
66
1
2
VSS
65
3
4
TXD_DISP
PCMBW0
TXD_DSP
64
5
6
C5VOUT2
63
7
8
/ATN2_DISP_3V
C5VOUT1
62
C3VIN1
61
UVDD
60
/ATN2_DSP_3V
CTL_RIN
59
/RESET
58
C3VOUT1
TXD_DISP_3V
57
C5VIN2
56
TXD_DSP_3V
C5VIN1
55
A0
A0
54
A1
A1
53
UVDD
52
UVDD
51
A2
A2
C322
100p
DGND
D[0..31]
POST_EQ_D[0..7]
C302
C303
C308
C309
0.01
0.01
0.01
0.01
C305
C306
C307
0.01
0.01
0.01
BCK2
BCK2
[DSP]
ST_D
ST_D
[DSP]
LRCK2
LRCK2
[DSP]
ADAT_D[0..3]
ADAT_D[0..3]
[DIF]
[DSP]
FXR_D1
[ROOT]
TXD_DISP
TXD_DSP
[DSP]
/ATN2_DISP_3V
/ATN2_DSP_3V
[ROOT]
TXD_DISP_3V
[CPU]
[CPU]
TXD_DSP_3V
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