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Samsung LW29A13W Service Manual page 93

Chassis al29ao, al40ao
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10 Schematic Diagrams
10-18 RTA+VD (2) Part Schematic Diagram
FPGA_DATA0
FPGA_CONF_DONE
+3.3V_LVDS
R200
10K
1/16W
1K
PORSEL
R201
R560
0
R561
C229
C230
1nF
10uF
A81
8
A82
82
A83
83
A8
84
A85
IC200
85
PQFP_OPT2
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86
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87
A88
88
A89
89
A90
90
A91
9
A92
92
A93
93
A9
94
A95
95
A96
96
A97
97
A98
98
A99
99
A100
00
+1.8V_FPGA
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R56
R565
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R3 7
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R351
10K
R356
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FPGA_nSTATUS
FPGA_DCLK
D200
SS2
+3 3V_LVDS
+3.3V_LVDS
C231
C232
C233
C23
C235
C236
100nF
100nF
100nF
100nF
100nF
100nF
PORSEL
IC201-2
Unknown
R570
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0
0
A
4
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R1
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0
AR 4
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R2
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0
A
5
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R3
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DQD3
L
R
R577
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A
6
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DQD
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R5
R578
0
AR 6
AR3
DQD5
L6
R6
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A 4
DQD6
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R7
R580
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AR20
AR4
DQD7
L8
R8
R58
0
A 2
AM9
DQD8
L9
R9
R582
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AR2
AM7
DQD9
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R10
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DQD10
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R11
R58
0
AR22
AM8
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L12
R12
R585
0
A 23
AN8
DQD12
L13
R13
R586
0
AR23
AN5
DQD13
L1
R1
R587
0
A 24
A 5
DQD1
L15
R15
R588
0
AR24
AR5
DQD15
L16
R16
AN6
R17
R589
0
AM 4
A 6
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R18
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0
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L18
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L19
R592
0
AN 5
DQE3
L20
R593
0
AM 6
DQE
L21
R59
0
AN 6
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R595
0
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L2
R597
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R600
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R602
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0
AM25
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0
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AR26
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L 0
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L 2
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0
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L
R6 7
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AM29
L 5
R618
0
A 28
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L 6
R619
0
AN29
L 7
R620
0
AR28
DQF15
L 8
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R 01
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WP
R 0
1/16W
1K
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R 11
1/16W
1K
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R 16
1/16W
1K
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R 20
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FPGA_DCLK
FPGA_nCONFIG
FPGA_nSTATUS
A50
50
A 9
49
TMS_8
A 8
48
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A 6
46
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A
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0
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4
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39
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R
0
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R
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R 52
0
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2
49
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DQ0
DQ 5
DQA15
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3
48
DQA1
DQ
DQ 4
4
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47
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5
46
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6
45
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DQ3
DQ 2
7
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DQA
8
43
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DQ
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9
42
DQA5
DQA10
DQ5
DQ 0
0
4
VSSO
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DQ6
DQ9
2
39
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DQ7
DQ8
DQA8
3
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4
37
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DQM
NC
5
36
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M_UDQL
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6
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M_CLK
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CKE
M_CLKE
M_RAS
8
33
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NC
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A0
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28
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ADDR[5]
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24
27
A3
A4
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25
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2
B
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C201
C202
C203
C20
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R202
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100nF
100nF
100nF
100nF
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2
L2
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L
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A
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AG32
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L1
A 32
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L17
AG35
L18
AG34
L19
A 35
L20
A 34
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AE34
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AD32
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L27
AB32
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AA32
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33
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L32
AD34
L33
AC35
L3
AC34
L35
AB35
L36
AB34
L37
AA34
L38
35
L39
R33
L 0
R32
L 1
33
L 2
32
L 3
N33
L
N32
L 5
M33
L 6
M32
L 7
35
L 8
R35
L 9
35
L50
34
L51
N34
L52
M35
L53
M34
L5
35
L55
AC5
L56
AD
L57
AD2
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AE
L62
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AE6
L66
AH
L67
AH3
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AH5
L69
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AH2
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A 3
L73
AG4
L7
A
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50
2
49
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DQ0
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3
48
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DQ
DQ 4
4
VSSO
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5
46
DQ2
DQ 3
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6
45
DQB12
DQ3
DQ 2
7
44
VDDO
VDDO2
DQB
8
43
DQ4
DQ
DQB11
9
42
DQB5
DQB10
DQ5
DQ 0
0
VSSO2 4
VSSO
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40
DQB9
DQ6
DQ9
2
39
DQB7
DQ7
DQ8
DQB8
3
VDDO
VDDO3
4
37
M_LDQL
DQM
NC
5
36
WE
UDQM
M_UDQL
M_WE
6
M_CAS
CAS
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M_CLK
RAS
CKE
M_CLKE
M_RAS
8
33
CS
NC
M_CS
9
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A9
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3
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A
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A2
A5
ADDR[5]
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24
27
A3
A4
ADDR[ ]
25
VDD
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+1.8V_FPGA
A
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2
B
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C206
C207
C208
C209
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C211
C2 2
C213
C21
C215
C216
C217
C218
C219
7 F
16V
100nF
100nF
100nF
100nF
100nF
100nF
100nF
100nF
100nF
100nF
100nF
100nF
100nF
100nF
R732
IC201-1
Unknown
IC20
+3 3V_FPGA
KM 16S1020BT-G/F10
VDD
VSS 50
2
49
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DQ0
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3
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DQ
DQ 4
4
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DQ 3
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C238
C239
C2 0
C2 1
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45
DQC12
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100uF
7
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100nF
100nF
100nF
100nF
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8
43
DQ4
DQ
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DQC5
DQC10
DQ5
DQ 0
0
4
VSSO
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DQC7
DQ7
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DQC8
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VDDO3
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DQM
NC
5
36
WE
UDQM
M_UDQL
6
CAS
C K
M_CLK
RAS
CKE
M_CLKE
8
33
CS
NC
9
BA
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3
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ADDR[0]
A0
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A
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ADDR[6]
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28
ADDR[2]
A2
A5
ADDR[5]
ADDR[3]
24
27
A3
A4
ADDR[ ]
25
VDD
VSS
CONFIDENTIAL
+3.3V_FPGA
A
A
FT200
FT201
BLM 1P600S
BLM 1P600S
2
2
B
B
C220
C221
C222
C223
C22
C225
C226
C227
C228
7 F
7uF
100nF
16V
100nF
100nF
100nF
16V
100nF
100nF
100nF
A
A
FT20
FT205
BLM 1P600S
BLM 1P600S
2
2
B
B
A 3
R1
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A 4
0
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R2
0
R306
A 5
R3
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0
R308
AK
R
ROA(3)
AK2
0
R310
R5
ROA( )
0
R312
AK3
R6
ROA(5)
AK4
0
R31
ROA(6)
R7
0
R315
AK5
R8
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0
R317
A
5
R9
ROB(0)
A
4
0
R319
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0
R321
A 7
R11
ROB(2)
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ROB(3)
A
3
0
R325
R13
ROB( )
0
R327
A
R1
ROB(5)
A 8
0
R329
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ROB(6)
AR8
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R16
ROB(7)
0
R333
AK6
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A
0
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0
R338
AM
R19
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A 34
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0
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A 33
R23
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0
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A 25
R2
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A 29
0
R350
GOB(0)
R25
0
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AN9
R26
GOB(1)
A 9
0
R355
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AR9
0
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0
R360
AM 0
R29
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AN 0
0
R362
R30
GOB(5)
A
0
0
R36
R31
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0
R366
AR 0
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0
R368
A 23
R33
BOA(0)
0
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A 22
R3
BOA(1)
A 2
0
R373
R35
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0
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A 5
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0
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A 20
R37
BOA( )
A
6
0
R379
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BOA(5)
0
R381
AR6
R39
BOA(6)
A
0
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BOA(7)
R 0
0
R38
AM
R 1
BOB(0)
0
R386
AN
R 2
BOB(1)
A
0
R388
R 3
BOB(2)
0
R390
AR
R
BOB(3)
A
2
0
R392
BOB( )
R 5
0
R39
AN 2
R 6
BOB(5)
0
R396
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100nF
100nF
100nF
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100nF
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100nF
100nF
100nF
100nF
10-27

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