Philips 40PFL4609/F7 Service Manual page 54

40” lcd tv chassis pl14.16
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Digital Main 3 Schematic Diagram [TYPE A]
1 NOTE:
The order of pins shown in this diagram is different from that of actual IC3101.
IC3101 is divided into seven and shown as IC3101 (1/7) ~ IC3101 (7/7) in this Digital Main Schematic Diagram Section.
*1
IC3101(2/7)
MN2WS0270HA
MAIN MICRO CONTROLLER
/DIGITAL SIGNAL PROCESS
R3433
10K
DDRPWRON
T5
MMVREF0
D3
MMVREF1
D16
MMVREF2
D6
MMDQ0
MMDQ0
D7
MMDQ1
MMDQ1
E6
4
MMDQ2
MMDQ2
B5
MMDQ3
MMDQ3
C5
MMDQ4
MMDQ4
C3
MMDQ5
MMDQ5
B1
MMDQ6
MMDQ6
C2
MMDQ7
MMDQ7
C1
MMDQ8
MMDQ8
C8
MMDQ9
MMDQ9
D8
MMDQ10
MMDQ10
C7
MMDQ11
MMDQ11
B7
MMDQ12
MMDQ12
C4
MMDQ13
MMDQ13
A3
MMDQ14
MMDQ14
B3
MMDQ15
MMDQ15
A2
MMDQ16
MMDQ16
D19
MMDQ17
MMDQ17
C18
MMDQ18
MMDQ18
B18
MMDQ19
MMDQ19
C17
MMDQ20
MMDQ20
B14
MMDQ21
MMDQ21
A14
MMDQ22
MMDQ22
C13
MMDQ23
MMDQ23
B13
MMDQ24
MMDQ24
B17
3
MMDQ25
MMDQ25
A17
MMDQ26
MMDQ26
D15
MMDQ27
MMDQ27
C15
MMDQ28
MMDQ28
B12
MMDQ29
MMDQ29
A12
MMDQ30
MMDQ30
D11
MMDQ31
MMDQ31
C11
MMDQS1
B4
MMXDQS1
A4
MMDQS0
A6
MMXDQS0
C6
MMDQS3
D17
MMXDQS3
C16
MMDQS2
B15
MMXDQS2
C14
MMDM1
C9
MMDM0
B2
MMDM3
C12
MMDM2
C19
R3405
56x4
MMA2
MMA2
G11
MMA6
MMA6
E8
MMA8
MMA8
G8
2
MMA14
MMA14
E7
R3406
56x4
MMA9
MMA9
E19
MMA11
MMA11
F18
MMA13
MMA13
E18
MMA7
MMA7
E17
R3407
56x4
MMA4
MMA4
D18
MMA5
MMA5
F17
MMA1
MMA1
F16
MMA12
MMA12
E16
R3408
56x4
MMBA1
D10
MMA10
MMA10
E10
MMA3
MMA3
D9
MMA0
MMA0
G9
R3409
56x4
MMBA2
G16
MMBA0
E15
MMXWE
D14
MMXCAS
E14
MMCK
B10
MMXCK
B9
R3418
56
MMXCS1
D12
R3417
56
MMXCS0
E11
R3416
56
MMODT0
F11
1
R3415
56
MEMORY
MMODT1
F12
I/F
R3414
56
MMCKE0
F10
R3413
56
MMCKE1
G10
R3412
56
MMXRAS
F14
MMXRESET
F19
TO DIGITAL
C3405
1
D1
R3419
MAIN 6
DDR3VOUT
R3420
240
10K
IC3101(5/7)
MMZQ
D4
NU
G7
NU
G12
M
R3421
270
R3423
270
R3411
270
IC3401
K4B1G1646G-BCK0
(DDR3 SDRAM)
M7
NU
MMA14
T7
A14
MMA13
T3
A13
MMA12
N7
A12/BC#
MMA11
R7
A11
MMA10
L7
A10/AP
MMA9
R3
A9
MMA8
T8
A8
MMA7
R2
A7
MMA6
R8
A6
VDDQ1
MMA5
P2
A5
VDDQ2
MMA4
P8
A4
VDDQ3
MMA3
N2
A3
VDDQ4
MMA2
P3
A2
VDDQ5
MMA1
P7
A1
VDDQ6
MMA0
N3
A0
VDDQ7
VDDQ8
VDDQ9
C7 DQSU
B7 DQSU#
F3 DQSL
VREFCA
G3 DQSL#
D3 DMU
VREFDQ
E7 DML
MMDQ11
A3
DQU7
MMDQ14
B8
DQU6
MMDQ10
A2
DQU5
MMDQ12
A7
DQU4
MMDQ8
C2
DQU3
MMDQ15
C8
DQU2
MMDQ9
C3
DQU1
MMDQ13
D7
DQU0
MMDQ6
H7
DQL7
MMDQ2
G2
DQL6
VSS10
MMDQ7
H8
DQL5
VSS11
MMDQ3
H3
DQL4
VSS12
MMDQ4
F8
DQL3
VSSQ1
MMDQ1
F2
DQL2
VSSQ2
MMDQ5
F7
DQL1
VSSQ3
MMDQ0
E3
DQL0
VSSQ4
VSSQ5
VSSQ6
L2 CS#
VSSQ7
K3 CAS#
VSSQ8
K1 ODT
VSSQ9
J3 RAS#
L3 WE#
T2 RESET#
L8 ZQ
R3428
240
M3
BA2
N8
BA1
M2
BA0
C3407
OPEN
N
O
VDD1
B2
MMA14
C3411
C3431
VDD2
D9
10
10
MMA13
VDD3
G7
MMA12
VDD4
K2
MMA11
C3408
C3412
C3413
C3414
VDD5
K8
1
0.1
0.1
0.1
MMA10
VDD6
N1
MMA9
VDD7
N9
MMA8
C3415
C3416
C3417
C3418
VDD8
R1
0.1
0.1
0.1
0.1
MMA7
VDD9
R9
MMA6
A1
MMA5
A8
MMA4
C1
MMA3
C9
MMA2
D2
MMA1
E9
MMA0
F1
H2
H9
R3425
270
M8
R3426
C3419
C3429
270
0.1
0.1
H1
MMDQ19
VSS1
A9
MMDQ22
VSS2
B3
MMDQ18
VSS3
E1
MMDQ20
VSS4
G8
MMDQ16
VSS5
J2
MMDQ23
VSS6
J8
MMDQ17
VSS7
M1
MMDQ21
VSS8
M9
MMDQ30
VSS9
P1
MMDQ26
P9
MMDQ31
T1
MMDQ27
T9
MMDQ28
B1
MMDQ25
B9
MMDQ29
D1
MMDQ24
D8
E2
E8
F9
G1
R3403
C3403
OPEN
OPEN
G9
R3427
220
CK J7
R3404
C3404
OPEN
OPEN
CK#
K7
CKE
K9
R3432
240
NU J1
NU J9
NU
L1
NU L9
P
10-7
DIGITAL MAIN CBA UNIT
CONTINUE
DIGITAL 7
AL+3.3V
VCC+1.5V
IC3402
K4B2G1646Q-BCMA
(DDR3 SDRAM)
M7
NU
VDD1
B2
C3420
C3432
T7
A14
VDD2
D9
10
10
T3
A13
VDD3
G7
N7
A12/BC#
VDD4
K2
C3421
C3422
C3423
C3424
R7
A11
VDD5
K8
0.1
0.1
0.1
0.1
L7
A10/AP
VDD6
N1
R3
A9
VDD7
N9
C3425
C3426
C3427
T8
A8
VDD8
R1
0.1
0.1
0.1
R2
A7
VDD9
R9
R8
A6
VDDQ1
A1
P2
A5
VDDQ2
A8
P8
A4
VDDQ3
C1
N2
A3
VDDQ4
C9
P3
A2
VDDQ5
D2
P7
A1
VDDQ6
E9
N3
A0
VDDQ7
F1
VDDQ8
H2
VDDQ9
H9
C7 DQSU
R3429
B7 DQSU#
270
F3 DQSL
VREFCA
M8
G3 DQSL#
R3430
C3428
C3430
270
0.1
0.1
D3 DMU
VREFDQ
H1
E7 DML
A3
DQU7
VSS1
A9
B8
DQU6
VSS2
B3
A2
DQU5
VSS3
E1
A7
DQU4
VSS4
G8
C2
DQU3
VSS5
J2
C8
DQU2
VSS6
J8
C3
DQU1
VSS7
M1
D7
DQU0
VSS8
M9
H7
DQL7
VSS9
P1
G2
DQL6
VSS10
P9
H8
DQL5
VSS11
T1
H3
DQL4
VSS12
T9
F8
DQL3
VSSQ1
B1
F2
DQL2
VSSQ2
B9
F7
DQL1
VSSQ3
D1
E3
DQL0
VSSQ4
D8
VSSQ5
E2
VSSQ6
E8
L2 CS#
VSSQ7
F9
K3 CAS#
VSSQ8
G1
R3401
C3401
OPEN
OPEN
K1 ODT
VSSQ9
G9
J3 RAS#
R3431
220
L3 WE#
CK J7
R3402
C3402
OPEN
OPEN
T2 RESET#
CK#
K7
L8 ZQ
CKE
K9
NU J1
M3
BA2
NU J9
N8
BA1
NU
L1
M2
BA0
NU L9
Q
R
PL14.16ASCD3

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