Texas Instruments TMS320VC5509 Data Manual page 7

Figure
2−1 179-Terminal GHH Ball Grid Array (Bottom View)
2−2 144-Pin PGE Low-Profile Quad Flatpack (Top View)
3−1 Block Diagram of the TMS320VC5509
3−2 Secure ROM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
3−3 TMS320VC5509 Memory Map (PGE Package)
3−4 TMS320VC5509 Memory Map (GHH Package)
3−5 DMA_CCR Bit Locations
3−6 External Bus Selection Register
3−7 Parallel Port Signal Routing
3−8 Parallel Port (EMIF) Signal Interface
3−9 I/O Direction Register (IODIR) Bit Layout
3−10 I/O Data Register (IODATA) Bit Layout
3−11 Address/GPIO Enable Register (AGPIOEN) Bit Layout
3−12 Address/GPIO Direction Register (AGPIODIR) Bit Layout
3−13 Address/GPIO Data Register (AGPIODATA) Bit Layout
3−14 EHPI GPIO Enable Register (EHPIGPIOEN) Bit Layout
3−15 EHPI GPIO Direction Register (EHPIGPIODIR) Bit Layout
3−16 EHPI GPIO Data Register (EHPIGPIODATA) Bit Layout
3−17 IFR0 and IER0 Bit Locations
3−18 IFR1 and IER1 Bit Locations
4−1 Device Nomenclature for the TMS320VC5509
5−1 3.3-V Test Load Circuit
5−2 Internal System Oscillator With External Crystal
5−3 Bypass Mode Clock Timings
5−4 External Multiply-by-N Clock Timings
5−5 Real-Time Clock Oscillator With External Crystal
5−6 Asynchronous Memory Read Timings
5−7 Asynchronous Memory Write Timings
5−8 Three SDRAM Read Commands
5−9 Three SDRAM WRT Commands
5−10 SDRAM ACTV Command
5−11 SDRAM DCAB Command
5−12 SDRAM REFR Command
5−13 SDRAM MRS Command
5−14 Power-Up Reset (On-Chip Oscillator Active) Timings
5−15 Power-Up Reset (On-Chip Oscillator Inactive) Timings
5−16 Reset Timings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
April 2001 − Revised January 2008
List of Figures
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SPRS163H