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Back-end Memory; (diagram M5) - Philips SD-5.31SL Service Manual

Dvd-video player, dvd module sd-5.31sl.
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Electrical Diagrams and PWB's
Bare Board: Back-end Memory
1
2
3

Back-end Memory

A
B
C
D
VCC3_BEM
E
49
43
9
3
27
14
1
VDDQ
VDD
MDATA(0)
2 DQ0
0V8
MDATA(1)
4 DQ1
0V8
LWE
MDATA(2)
5 DQ2
DATA INPUT
0V8
MDATA(3)
REGISTER
7 DQ3
0V8
LDQM
MDATA(4)
8 DQ4
0V8
F
MDATA(5)
10 DQ5
1V2
1M x 16
MDATA(6)
11 DQ6
0V8
1M x 16
MDATA(7)
13 DQ7
0V5
1M x 16
MDATA(8)
42
DQ8
0V8
1M x 16
MDATA(9)
44
DQ9
0V8
MDATA(10)
45
DQ10
0V8
MDATA(11)
47
DQ11
COLUMN
0V8
G
DECODER
MDATA(12)
48
DQ12
0V8
MDATA(13)
50
DQ13
1V2
LATENCY &
BURST LENGTH
MDATA(14)
51
DQ14
1V2
MDATA(15)
53
DQ15
0V8
PROGRAMMING
LRAS
REGISTER
LCBR
36
NC
LWCBR
40
NC|RFU
H
LWE
LQDM
VSSQ
VSS
52
46
12
6
54
41
28
I
GND
*RESERVE
V
DC vtg measured in STOP-mode
BARE BOARD : 3139 243 3063.4
1
2
3
SD-5.31SL
4
5
6
UPA(1)
UPA(2)
UPA(3)
UPA(4)
UPA(5)
UPA(6)
UPA(7)
UPA(8)
UPA(9)
UPA(10)
UPA(11)
UPA(12)
UPA(13)
UPA(14)
UPA(15)
UPA(16)
UPA(17)
UPA(18)
+3.3V
UPA(19)
UPA(22)
7500
1R0
NCP303
3503
UPA(20)
2 INP
+5V
F501
OUTP
1
SYS_RST
2V6
M4,M5,M7
4
NC RESET
CD
GND
5
3
GND
5502
+5V
GND
GND
7502
K4S641632F
BA0
20
1V4
BA0
BANK
BA1 21
1V4
BA1
SELECT
A0 23
0V3
MADDR(0)
A1 24
MADDR(1)
0V3
A2 25
MADDR(2)
0V3
A3 26
MADDR(3)
0V5
A4 29
MADDR(4)
0V5
A5 30
MADDR(5)
0V5
A6 31
MADDR(6)
0V5
A7 32
MADDR(7)
0V5
A8 33
MADDR(8)
0V3
A9 34
MADDR(9)
0V3
A10|AP
22
1V6
MADDR(10)
A11 35
MADDR(11)
0V3
LCKE
CLK 38
SD_CLK
1V6
VCC3_BEM
CKE 37
3508
MCS0
1R0
CS_ 19
3V
MCS0#
RAS_
18
2V8
MRAS
CAS_
17
2V8
MCAS
WE_
16
3V
MWE
UDQM
39
0V2
MDQM1
LDQM 15
0V2
MDQM0
TO
ZIVA SDRAM INTERFACE
4
5
6
7.
37
7
8
9
VCC3_BEF
7501
980020-48-02
37
VCC
25
29
UPD(0)
0V
0V
A0
DQ0
24
31
0V
0V
UPD(1)
A1
DQ1
23
33
UPD(2)
0V
0V
A2
DQ2
22
35
3V
0V
UPD(3)
A3
DQ3
21
38
UPD(4)
3V
0V
A4
DQ4
20
40
0V
0V
UPD(5)
A5
DQ5
19
42
UPD(6)
0V
0V
A6
DQ6
18
44
3V
0V
UPD(7)
A7
DQ7
8
30
UPD(8)
0V
0V
A8
DQ8
7
32
0V
0V
UPD(9)
A9
DQ9
6
34
UPD(10)
0V
0V
A10
DQ10
5
36
0V
0V
UPD(11)
A11
DQ11
4
39
UPD(12)
0V
0V
A12
DQ12
3
41
0V
0V
UPD(13)
A13
DQ13
2
43
UPD(14)
0V
0V
A14
DQ14
1
45
0V
3V5
UPD(15)
A15
DQ15|A-1
48
0V
A16
3501
15
UPA(20)
2V3
RY|BY_
17
0V
A17
1R0
16
0V
A18
3502
9
0V
A19
1R0
10
UPA(21)
0V
NC2
26
M4
3V
CE_
3504
4K7
VCC3_BEF
FLASH_CS
13
NC3
28
M4
3V
OE_
3505 4K7
14
R_W
NC4
11
M4
3V
WE_
UDS
GND
12
M5
2V6
RESET_
SYS_RST
47
BYTE_
VSS1
VSS2
27
46
GND
GND
VCC3_BEF
MDATA(16)
2
DQ0
0V8
MDATA(17)
4
DQ1
0V8
MDATA(18)
5
DQ2
0V8
7
DQ3
MDATA(19)
0V8
MDATA(20)
8
DQ4
0V8
10
DQ5
MDATA(21)
0V8
MDATA(22)
11
DQ6
0V5
MDATA(23)
13
DQ7
0V8
MDATA(24)
42 DQ8
0V8
44 DQ9
MDATA(25)
0V8
MDATA(26)
45 DQ10
0V6
47 DQ11
MDATA(27)
0V6
MDATA(28)
48 DQ12
0V9
MDATA(29)
50 DQ13
0V5
MDATA(30)
51 DQ14
0V5
53 DQ15
MDATA(31)
0V9
36
NC
40 NC|RFU
52
7
8
9
10
11
12
TO
ZIVA HOST
+3.3V
VCC3_BEF
GND
+3.3V
F503
VCC3_BEM
GND
VCC3_BEM
7503
49
43
9
3
27
14
1
K4S641632F
VDDQ
VDD
BA0 20
1V4
BA0
BANK
BA1
21
BA1
1V4
SELECT
LWE
A0
23
MADDR(0)
DATA INPUT
0V3
REGISTER
A1
24
0V3
MADDR(1)
LDQM
A2
25
MADDR(2)
0V3
A3
26
MADDR(3)
0V5
1M x 16
A4
29
MADDR(4)
0V5
1M x 16
A5
30
MADDR(5)
0V5
1M x 16
A6
31
MADDR(6)
0V5
1M x 16
A7
32
MADDR(7)
0V5
A8
33
MADDR(8)
0V3
A9
34
COLUMN
MADDR(9)
0V3
DECODER
A10|AP 22
MADDR(10)
1V6
A11
35
MADDR(11)
LATENCY &
0V3
BURST LENGTH
LCKE
CLK
38
SD_CLK
1V6
PROGRAMMING
LRAS
VCC3_BEM
CKE
37
REGISTER
CS_
19
MCS0#
3V
LCBR
LWCBR
RAS_ 18
2V8
MRAS
LWE
CAS_ 17
MCAS
2V8
WE_ 16
3V
MWE
UDQM 39
MDQM3
0V2
LDQM
15
0V2
MDQM2
LQDM
VSSQ
VSS
46
12
6
54
41
28
GND
10
11
12
2500 D5
13
2502 B11
2503 D6
2504 D5
2505 D10
2506 D11
2507 D11
2508 D11
2509 D11
2510 D11
2511 D11
2512 D11
A
2513 D6
2514 E3
2515 E3
2516 E3
2517 E4
2518 E4
2519 E4
2520 E4
2521 G13
2522 H13
3500 D5
3501 C8
B
3502 D7
3503 D6
3504 D8
3505 D9
3506 D7
3507 G13
3508 H4
3510 H13
5500 A11
5501 D10
5502 D6
7500 D5
C
7501 A7
7502 E4
7503 E11
F501 D5
F502 G13
F503 D11
D
E
F
F502
SD_CLK
G
GND
MCS0#
H
GND
I
CL 36532043_039.eps
270503
13

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